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教程资料  Verilog RTL代码新手上路教程

通过学习本教程提供的各种RTL小型电路模块的代码并且观察电路的RTL结构和波形仿真的时序，可以快速的了解如何设计基本的电路组件

https://www.eeworm.com/dl/fpga/doc/32078.html

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教程资料  频率扫描的VHDL完整代码

大家好，刚刚参加电子发烧友论坛，分享给大家一个我以前做的一个频率扫描的VHDL代码，希望大家喜欢！！！

https://www.eeworm.com/dl/fpga/doc/32160.html

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教程资料  VHDL代码风格和常见的语法错误分析

VHDL代码风格和常见的语法错误分析

https://www.eeworm.com/dl/fpga/doc/32199.html

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教程资料  Altera器件的推荐代码风格

01_Altera器件的推荐代码风格

https://www.eeworm.com/dl/fpga/doc/32200.html

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教程资料  传统时序分析器TAN到基于SDC的Timequest时序分析器转换

03_传统时序分析器TAN到基于SDC的Timequest时序分析器转换

https://www.eeworm.com/dl/fpga/doc/32212.html

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教程资料  FIFO的verilog代码

FIFO的verilog代码

https://www.eeworm.com/dl/fpga/doc/32338.html

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介绍了基于Xilinx Spartan- 3E FPGA XC3S250E 来完成分辨率为738×575 的PAL 制数字视频信号到800×600 的VGA 格式转换的实现方法。关键词: 图像放大; PAL; VGA; FPGA 目前, 绝大多数监控系统中采用的高解析度摄像机均由47 万像素的CCD 图像传感器采集图像, 经DSP 处理后输出的PAL 制数字视频信号不能直接在VGA 显示器上显 ...

https://www.eeworm.com/dl/fpga/doc/32691.html

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教程资料  基于 FPGA 的 SDTV-HDTV 转换的研究与设计

一种采用Altera Cyclone Ⅲ FPGA将标准清晰度电视(SDTV)转换成高清晰度电视(HDTV)的方法.用图像插值技术,充分利用了原始图像,实现视频格式水平方向上行内像素点的增加及垂直方向上行数的提升,满足高清晰度电视格式的标准输出.整个上变换模块的复杂度低,易于硬件实现,完成了专用格式转换芯片的功能,在工程应用中有利于提高系 ...

https://www.eeworm.com/dl/fpga/doc/32705.html

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教程资料  基于FPGA的多路高速串并转换器设计

高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISE ...

https://www.eeworm.com/dl/fpga/doc/32712.html

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教程资料  ZBT SRAM控制器参考设计,xilinx提供VHDL代码

ZBT SRAM控制器参考设计,xilinx提供VHDL代码 Description: &nbsp; Contains the following files &nbsp;&nbsp;&nbsp; readme.txt appnote_zbtp.vhd appnote_zbtf.vhd appnote_zbt.ucf Platform: &nbsp; All Installation/Use: &nbsp; Use &#39;unzip&#39; on the .zip file and &#39;gunzip&#39; followed by & ...

https://www.eeworm.com/dl/fpga/doc/32716.html

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