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其他  数字系统设计实例.pdf,VHDL语言实现

数字系统设计实例.pdf,VHDL语言实现，7.1 半整数分频器的设计7.2 音乐发生器7.3 2FSK/2PSK信号产生器7.4 实用多功能电子表7.5 交通灯控制器 7.6 数字频率计.值得一看。

https://www.eeworm.com/dl/534/190806.html

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其他嵌入式/单片机内容  三八译码器的源代码

三八译码器的源代码，在quartus II 6.0中进行进行设计的，有vhdl源代码

https://www.eeworm.com/dl/687/193120.html

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其他  密码锁的VHDL实现

密码锁的VHDL实现，分为几个部分。包括除颤抖电路，译码器，等

https://www.eeworm.com/dl/534/193746.html

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VHDL/FPGA/Verilog VHDL的49个例子

VHDL的49个例子，例子丰富，有计数器、状态机、寄存器、汉明纠错码编码器、游戏程序

https://www.eeworm.com/dl/663/197597.html

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其他  移位寄存器

移位寄存器，用VHDL语言编码，可能对你用处不是很大，但做为参考还是很大用处的

https://www.eeworm.com/dl/534/200608.html

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其他  分频器

分频器，用VHDL语言编码，可能对你用处不是很大，但做为参考还是很大用处的

https://www.eeworm.com/dl/534/200612.html

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系统设计方案  本秒表计时器用于体育竞赛及各种要求有较精确时的各领域。此计时器是用一块专用的芯片

本秒表计时器用于体育竞赛及各种要求有较精确时的各领域。此计时器是用一块专用的芯片，用VHDL语言描述的。它除开关、时钟和显示功能以外，它还包括1/100s计时器所有的控制和定时功能，其体积小，携带方便。

https://www.eeworm.com/dl/678/209455.html

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书籍源码  100个经典vhdl编程实例

100个经典vhdl编程实例，第1例带控制端口的加法器第2例无控制端口的加法器第3例乘法器第4例比较器第5例二路选择器第6例寄存器第7例移位寄存器第8例综合单元库第9例七值逻辑与基本数据类型第10例函数第11例七值逻辑线或分辨函数第12例转换函数第13例左移函数第14例七值逻辑程序包第15例四输入 ...

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软件设计/软件工程  ---实现的部分VHDL 程序如下。　　--- elsif clk1x event and clk1x = 1 then ---if std_logic_vector(length_no)

---实现的部分VHDL 程序如下。　　--- elsif clk1x event and clk1x = 1 then ---if std_logic_vector(length_no) >= “0001” and std_logic_vector(length_no) <= “1001” then -----数据帧数据由接收串行数据端移位入接收移位寄存器---rsr(0) <= rxda --- rsr(7 downto 1) <= rsr(6 downto 0) --- parity <= parity ...

https://www.eeworm.com/dl/684/214662.html

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VHDL/FPGA/Verilog 我自己写的vhdl程序

我自己写的vhdl程序，内有画图器，ram 和控制ram。还有test bentch。

https://www.eeworm.com/dl/663/216623.html

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