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交织器 vhdl 的查询结果
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VHDL/FPGA/Verilog 一种基于移位寄存器的CAM的VHDL实现,提供下载.
一种基于移位寄存器的CAM的VHDL实现,提供下载.
VHDL/FPGA/Verilog 通过VHDL实现4位全加器
通过VHDL实现4位全加器，8位全加器，和8位通用寄存器的设计
VHDL/FPGA/Verilog 用VHDL写的一个5/8分频器,希望对刚学习VHDL的朋友有帮助
用VHDL写的一个5/8分频器,希望对刚学习VHDL的朋友有帮助
VHDL/FPGA/Verilog 用VHDL写的一个8位全加器的实验程序,供新手参考
用VHDL写的一个8位全加器的实验程序,供新手参考
VHDL/FPGA/Verilog 有VHDL写的一个38译码器,并付仿真波形.
有VHDL写的一个38译码器,并付仿真波形.
VHDL/FPGA/Verilog :传统的交通灯控制器多数由单片机或PLC来实现,文中介绍了基于VHDL硬件描述语言进行交通灯控制 器设计的一般思路和方法。选择XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5.
:传统的交通灯控制器多数由单片机或PLC来实现,文中介绍了基于VHDL硬件描述语言进行交通灯控制
器设计的一般思路和方法。选择XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5. X和MODELSIM
SE 6. 0开发工具进行了程序的编译和功能仿真。最后给出了交通灯控制器的部分VHDL源程序和仿真结果,仿
真结果表明该系统的设计 ...
VHDL/FPGA/Verilog 适用异步收发器设计的vhdl语言,是学习UART知识的好例程
适用异步收发器设计的vhdl语言,是学习UART知识的好例程
其他 这是Actel 的FPGA的译码器的VHDL源代码。
这是Actel 的FPGA的译码器的VHDL源代码。
VHDL/FPGA/Verilog 8位全加器的VHDL描述
8位全加器的VHDL描述，可用MAX+plusⅡ运行测试