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matlab例程 遗传算法程序: 说明: fga.m 为遗传算法的主程序 采用二进制Gray编码,采用基于轮盘赌法的非线性排名选择, 均匀交叉,变异操作,而且还引入了倒位操作!

遗传算法程序: 说明: fga.m 为遗传算法的主程序 采用二进制Gray编码,采用基于轮盘赌法的非线性排名选择, 均匀交叉,变异操作,而且还引入了倒位操作!
https://www.eeworm.com/dl/665/431304.html
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其他 五、 进制转换器(10) 要求:(1)可输入二进制、八进制、十进制、十六进制数; (2)将已输入的数转换成其余进制的数; (3)具有输入输出界面。

五、 进制转换器(10) 要求:(1)可输入二进制、八进制、十进制、十六进制数; (2)将已输入的数转换成其余进制的数; (3)具有输入输出界面。
https://www.eeworm.com/dl/534/431883.html
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其他 五、 进制转换器(10)(方法 2) 要求:(1)可输入二进制、八进制、十进制、十六进制数; (2)将已输入的数转换成其余进制的数; (3)具有输入输出界面

五、 进制转换器(10)(方法 2) 要求:(1)可输入二进制、八进制、十进制、十六进制数; (2)将已输入的数转换成其余进制的数; (3)具有输入输出界面。
https://www.eeworm.com/dl/534/431884.html
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通讯编程文档 用VHDL实现3位二进制信息码的并行偶发生及校验电路

用VHDL实现3位二进制信息码的并行偶发生及校验电路
https://www.eeworm.com/dl/646/432685.html
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VHDL/FPGA/Verilog 改程序用VHDL编写 实现由8位二进制数转化成整数的功能

改程序用VHDL编写 实现由8位二进制数转化成整数的功能
https://www.eeworm.com/dl/663/434549.html
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VHDL/FPGA/Verilog 两位独立数码管100进制计数器

两位独立数码管100进制计数器,每1秒计数一次。从0到99,到99后又回到0.
https://www.eeworm.com/dl/663/453089.html
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其他 使用状态机设计一个5位序列检测器。从一串二进制码中检测出一个已预置的5位二进制码

使用状态机设计一个5位序列检测器。从一串二进制码中检测出一个已预置的5位二进制码
https://www.eeworm.com/dl/534/454371.html
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文章/文档 1位全加器 可以进行1位的二进制码的加法 想进行改进 改为4位或8位的全加器代码

1位全加器 可以进行1位的二进制码的加法 想进行改进 改为4位或8位的全加器代码
https://www.eeworm.com/dl/652/455506.html
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文章/文档 基本的位运算中的二进制逆序操作

基本的位运算中的二进制逆序操作,有详细的说明
https://www.eeworm.com/dl/652/456317.html
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VHDL/FPGA/Verilog 4位二进制加法器

4位二进制加法器,vhdl实现,外带译码器部分,清晰简洁,可读性好
https://www.eeworm.com/dl/663/460667.html
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