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共 1,406 条结果

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Linux/uClinux/Unix编程 32位单精度加法器

32位单精度加法器，在嵌入式可能会用的到
https://www.eeworm.com/dl/508378.html
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数值算法/人工智能 递推最小二乘算法

递推最小二乘算法，一种建模方法，含完整程序和仿真结果。
https://www.eeworm.com/dl/511098.html
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应用设计 verilog设计加法器

用verilog设计加法器，经modelsim仿真测试没问题。有问题请反馈。
https://www.eeworm.com/dl/514225.html
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应用设计 Verilog设计的加法器

用verilog设计的加法器，经过modelsim工具验证无问题。有问题请反馈。
https://www.eeworm.com/dl/514235.html
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论文 一位加法器

题目：一位加法器的设计 试实现一个十进制的1位数加法器，其中十进制数编码为8421码。十进制数加法可首先转换为二进制加法来执行。然后，若得到的和大于9，则产生一个进位值，并在得到的和值上加6(这是用来补足未使用的六种输入组合)。 要求：（1）利用基本逻辑门电路和编码器，译码器及计数器完成电路； （2） ...
https://www.eeworm.com/dl/514996.html
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电路图 Multisim加法器

Multisim十进制加法器 范围0到18
https://www.eeworm.com/dl/518502.html
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技术资料 基于51单片机的8乘8LED点阵显示屏的设计

基于51单片机的8乘8LED点阵显示屏的设计这是一份非常不错的资料，欢迎下载，希望对您有帮助！
https://www.eeworm.com/dl/830568.html
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技术资料 Q-JLY-J7110779B-2014《乘用车电气／电子零部件电磁兼容规范》(秘密级)

Q-JLY-J7110779B-2014《乘用车电气／电子零部件电磁兼容规范》(秘密级)，有需要的可以参考！
https://www.eeworm.com/dl/832662.html
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技术资料 基于Altera的FPGA设计的硬件除法器

基于Altera的FPGA设计的硬件除法器，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈
https://www.eeworm.com/dl/834256.html
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技术资料 FU6831产品数据手册

FU6831 是一款集成 8051 内核和电机控制引擎(ME)的电机驱动专用芯片，8051 内核处理常规事务，ME 处理电机实时事务，双核协同工作实现各种高性能电机控制。其中 8051 内核大部分指令周期为 1T 或 2T，芯片内部集成有高速运算放大器、比较器、Pre-driver、高速 ADC、高速乘/除法器、CRC、SPI、I2C、UART、多种 TIMER、PWM 等 ...
https://www.eeworm.com/dl/838866.html
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