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找到约 1,406 项符合 乘法器 的查询结果

数值算法/人工智能 它建立在最优原则的基础上,采用动态规划方法,可以优雅而高效地解决许多用贪心技术或分治技术无法解决的问题。因此,动态规划技术越来越成为解决许多重要的应用问题的关键技术。矩阵连乘。

它建立在最优原则的基础上,采用动态规划方法,可以优雅而高效地解决许多用贪心技术或分治技术无法解决的问题。因此,动态规划技术越来越成为解决许多重要的应用问题的关键技术。矩阵连乘。
https://www.eeworm.com/dl/518/379672.html
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VHDL/FPGA/Verilog 十六位的除法器

十六位的除法器,采用verilog hdl
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Linux/Unix编程 计算阶乘的程序 在红旗linux桌面6.0(linux内核版本2.6.23.1-4)

计算阶乘的程序 在红旗linux桌面6.0(linux内核版本2.6.23.1-4),gcc版本4.2.1条件下成功运行,计算结果正确。
https://www.eeworm.com/dl/619/380964.html
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Linux/Unix编程 计算阶乘的程序。 在内核为2.6.23.1-4的红旗LINUX下成功运行

计算阶乘的程序。 在内核为2.6.23.1-4的红旗LINUX下成功运行,结果正确。 特点:有效位数精确到最低位(即乘法结果有几位有效数字有几位)。
https://www.eeworm.com/dl/619/380991.html
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VHDL/FPGA/Verilog 介绍了利用VHDL实现八位除法,采用层次化设计,该除法器采用了VHDL的混合输入方式,将除法器分成若干个子模块后,对各个子模块分别设计,各自生成功能模块完成整体设计,实现了任意八位无符号数的除法。

介绍了利用VHDL实现八位除法,采用层次化设计,该除法器采用了VHDL的混合输入方式,将除法器分成若干个子模块后,对各个子模块分别设计,各自生成功能模块完成整体设计,实现了任意八位无符号数的除法。
https://www.eeworm.com/dl/663/381553.html
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VHDL/FPGA/Verilog 移位快速除法器

移位快速除法器,通过一次移4位试商实现快速除法功能,较普通减除法器有及其巨大的效率提升
https://www.eeworm.com/dl/663/381979.html
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数据结构 阅读您的文件最小二乘匹配and高斯解方程子程序

阅读您的文件最小二乘匹配and高斯解方程子程序
https://www.eeworm.com/dl/654/382054.html
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数学计算 1.г函数、贝塔函数、阶乘及二项式系数 2.不完全г函数、误差函数 3.不完全贝塔函数 4.零阶、一阶和任意整数阶的第一、二类贝赛函数 5.零阶、一阶和任意整数阶的第一、二类变形贝赛函数 6

1.г函数、贝塔函数、阶乘及二项式系数 2.不完全г函数、误差函数 3.不完全贝塔函数 4.零阶、一阶和任意整数阶的第一、二类贝赛函数 5.零阶、一阶和任意整数阶的第一、二类变形贝赛函数 6.分数阶第一类贝赛尔函数和变形贝赛尔函数 7.指数积分和定指数积分 8.连带勒让德函数 ...
https://www.eeworm.com/dl/641/382440.html
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单片机开发 单片机;计算器;微电子;模拟电路能进行正数加、减、乘、除四则运算的计算器叫做简单计算器;科学计算器是指能兼容正数的四则运算和乘方、开方运算

单片机;计算器;微电子;模拟电路能进行正数加、减、乘、除四则运算的计算器叫做简单计算器;科学计算器是指能兼容正数的四则运算和乘方、开方运算,具有指数、对数、三角函数、反三角函数及存储等计算功能的计算器。 ...
https://www.eeworm.com/dl/648/383176.html
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VHDL/FPGA/Verilog 一种用VHDL语言描述的浮点乘前规格化的源代码编程

一种用VHDL语言描述的浮点乘前规格化的源代码编程
https://www.eeworm.com/dl/663/383876.html
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