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乘法器 的查询结果
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VHDL/FPGA/Verilog vhdl 测试向量含测试向量（Test Bench）和波形产生：VHDL实例---相应加法器的测试向量（test bench).txt
vhdl 测试向量含测试向量（Test Bench）和波形产生：VHDL实例---相应加法器的测试向量（test bench).txt
VHDL/FPGA/Verilog 16位高速加法器
16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行
数据结构 用matlab编写的一个程序,实现系统辨识中的最小二乘递推算法,有运行结果和图形.
用matlab编写的一个程序,实现系统辨识中的最小二乘递推算法,有运行结果和图形.
matlab例程 这是黑龙江大学自控理论杨易朋同学在最优估计课程当中用matlab编写的递推增广最小二乘算法!
这是黑龙江大学自控理论杨易朋同学在最优估计课程当中用matlab编写的递推增广最小二乘算法!
matlab例程 这是黑龙江大学自动控制专业杨易鹏同学用matlab编写的广义最小二乘算法!
这是黑龙江大学自动控制专业杨易鹏同学用matlab编写的广义最小二乘算法!
matlab例程 ％利用乘同余法写的白噪声程序 ％对于辨识有一定帮助 ％相关方法可以参照乘同余法原理
％利用乘同余法写的白噪声程序
％对于辨识有一定帮助
％相关方法可以参照乘同余法原理
软件设计/软件工程 1.能实现不同的个数的矩阵连乘. 2.最后矩阵大小是8X8. 3是最优的矩阵相乘. 描 述：给定n 个矩阵｛A1, A2,...,An｝
1.能实现不同的个数的矩阵连乘.
2.最后矩阵大小是8X8.
3是最优的矩阵相乘.
描 述：给定n 个矩阵｛A1, A2,...,An｝，其中Ai与Ai+1是可乘的，i=1，2…，n-1。考察这n个矩阵的连乘积A1A2...An。矩阵A 和B 可乘的条件是矩阵A的列数等于矩阵B 的行数。若A 是一个p x q矩阵，B是一个q * r矩阵，则其乘积C=AB是一个p * r矩阵,需 ...
VHDL/FPGA/Verilog 这是用vhdl编写的四位加法器
这是用vhdl编写的四位加法器，请多指教
VHDL/FPGA/Verilog 基于maxplus2的八位加法器
基于maxplus2的八位加法器，已经通过仿真
VHDL/FPGA/Verilog 数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述
数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。