搜索：主时钟
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https://www.eeworm.com/dl/534/386830.html
其他
编写具有如下函数原型的递归与非递归两种函数equ
编写具有如下函数原型的递归与非递归两种函数equ，负责判断数组a与b的前n个元素值是否按下标对应完全相同，是则返回true，否则返回false。并编制主函数对它们进行调用，以验证其正确性。
bool equ(int a[], int b[], int n)
提示：递归函数中可按如下方式来分解并处理问题，先判断最后一个元素是否相 ...
https://www.eeworm.com/dl/843217.html
技术资料
一种二总线远供电源及其通信系统
一种二总线远供电源及其通信系统在 大 型 、 远 程 监 测 系 统 中 , 例 如 石 油 、 化 工 、 电 力 、火 灾监 控 、 水利监 测 等系统 , 需 要 把 这 些探 测 器测得 的数据准 确 可 靠地 收集起 来 , 同时 主 控制 站 也 需 要 向执行 机 构发 送 一 些 控制命令 。 针 对 这 种 系统 覆 盖 地 域范 ...
https://www.eeworm.com/dl/862511.html
技术资料
反激电源设计指南
功率电路与控制电路的位置应明显分开，功率电路的布线与
控制电路的布线尽量少交叉，减少功率电路对控制电路干扰。
– 地参考是整个系统运行的基础，布线时须特别注意。首先必
须避免地环路；地线须选择更粗线径的线，以减小地阻抗；
避免较长的地连线，以减小地线的引线电感。
– 控制电路与主电路的 ...
https://www.eeworm.com/dl/897757.html
技术资料
基于单片机的智能门禁系统设计
随着电子技术、集成电路技术、计算机技术、传感技术、射频识别技术的飞跃发展,人们的生活方式不断向着舒适化、智能化方向发展。当今时代人们对于安全的要求越来越高,因此急需一款电子产品用来保护人们的人身安全和财产安全。本设计以STC89C52作为密码控制主芯片,通过不同形式输入模块如矩阵键盘、刷卡 ...
https://www.eeworm.com/dl/514/12035.html
学术论文
基于ARM与FPGA的高速数据采集技术研究
本文研究基于ARM与FPGA的高速数据采集系统技术。论文完成了ARM+FPGA结构的共享存储器结构设计，实现了ARMLinux系统的软件设计，包括触摸屏控制、LCD显示、正弦插值算法设计以及各种显示算法设计等。同时进行了信号的高速采集和处理的实际测试，对实验测试数据进行了分析。 论文分别从软件和硬件两方面 ...
https://www.eeworm.com/dl/885798.html
技术资料
基于ARM与FPGA的高速数据采集技术研究
本文研究基于ARM与FPGA的高速数据采集系统技术。论文完成了ARM+FPGA结构的共享存储器结构设计，实现了ARMLinux系统的软件设计，包括触摸屏控制、LCD显示、正弦插值算法设计以及各种显示算法设计等。同时进行了信号的高速采集和处理的实际测试，对实验测试数据进行了分析。 论文分别从软件和硬件两方面 ...
https://www.eeworm.com/dl/887493.html
技术资料
基于ARM与FPGA的高速数据采集技术研究.rar
本文研究基于ARM与FPGA的高速数据采集系统技术。论文完成了ARM+FPGA结构的共享存储器结构设计，实现了ARMLinux系统的软件设计，包括触摸屏控制、LCD显示、正弦插值算法设计以及各种显示算法设计等。同时进行了信号的高速采集和处理的实际测试，对实验测试数据进行了分析。 论文分别从软件和硬件两方面 ...
https://www.eeworm.com/dl/571/20226.html
模拟电子
一种改进的基于时间戳的空间音视频同步方法
空间多媒体通信过程中存在的不可预测的分组数据丢失、乱序，可变的链路传输及处理时延抖动以及收发端时钟不同步与漂移等问题，这可能导致接收端在对音视频数据进行显示播放时产生音视频不同步现象。为了解决此问题，提出了一种改进的基于时间戳的空间音视频同步方法，该方法采用一种相对时间戳映射模型 ...
https://www.eeworm.com/dl/501/22268.html
PCB相关
高速电路传输线效应分析与处理
随着系统设计复杂性和集成度的大规模提高，电子系统设计师们正在从事100MHZ以上的电路设计，总线的工作频率也已经达到或者超过50MHZ，有一大部分甚至超过100MHZ。目前约80% 的设计的时钟频率超过50MHz，将近50% 以上的设计主频超过120MHz，有20%甚至超过500M。当系统工作在50MHz时，将产生传输线效应和 ...
https://www.eeworm.com/dl/564/33193.html
通信网络
力科PCIE 3.0系列文章之一——PCIE 3.0的发射机物理层测试
PCIE 3.0相对于它的前一代PCIE 2.0的最主要的一个区别是速率由5GT/s提升到了8GT/s。为了保证数据传输密度和直流平衡以及时钟恢复，PCIE 2.0中使用了8B/10B编码，即将每8位有效数据编码为10位数据进行传输，这样链路中将会有20%信息量是无效的，即使得链路的最大传输容量打了20%的折扣。而速率提升的目 ...