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有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的.
练习三 利用条件语句实现计数分频时序电路
实验目的:
1. 掌握条件语句在简单时序模块设计中的使用;
2. 学习在Verilog模块中应用计数器;
3. 学习测试模块的编写、综合和不同层次的仿真。
练习四 阻塞赋值与非阻塞赋值的区别
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1. 通过实验,掌握阻塞赋值与 ...
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文章给出一种用三片TMS320C50构成,基于PC机的多DSP系统,该系统既能适应并行信号处理,又能适应流水信号处理。介绍了数据采集电路,DSP器件间的数据通信设计,以及DSP器件与PC机的接口电路,最后给出两种具体应用实例。
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245为三态输出的八组总线收发器,其主要电器特性的典型值如下(不同厂家
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373为三态输出的八D透明锁存器,共有54/74S373和54/74L373两种线路结构