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汇编语言  片机电子钟的计时脉冲基准是由外部晶振的频率经过12分频后提供

片机电子钟的计时脉冲基准是由外部晶振的频率经过12分频后提供，采用内部的定时/计数器来实现计时功能。所以，外接晶振频率精确度直接影响电子钟计时的准确性。

https://www.eeworm.com/dl/644/359288.html

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汇编语言  verilog写的分频程序,可以对输入的频率分频

verilog写的分频程序,可以对输入的频率分频

https://www.eeworm.com/dl/644/361321.html

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VHDL/FPGA/Verilog 任意基数分频VERILOG代码

任意基数分频VERILOG代码，经过了编译，可以修改数字改变分频。

https://www.eeworm.com/dl/663/362527.html

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VHDL/FPGA/Verilog VHDL产生时钟50分频程序

VHDL产生时钟50分频程序，供初学者参考

https://www.eeworm.com/dl/663/364436.html

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单片机开发  一个ＤＤＳ前端的串口通讯编程的程序。可以实现分频和指定步进的计数。计到终点值就锁定频率。

一个ＤＤＳ前端的串口通讯编程的程序。可以实现分频和指定步进的计数。计到终点值就锁定频率。

https://www.eeworm.com/dl/648/365789.html

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书籍源码  比较好的分频代码

比较好的分频代码，我自己写的，已调试成功

https://www.eeworm.com/dl/532/366067.html

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VHDL/FPGA/Verilog 此程序是用硬件描述语言VHDL编写的分频程序

此程序是用硬件描述语言VHDL编写的分频程序，实现了不同的频率输入。

https://www.eeworm.com/dl/663/367024.html

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书籍源码  可以对输入时钟任意分频(整数或小数),带Quartus II 完整项目文件.

可以对输入时钟任意分频(整数或小数),带Quartus II 完整项目文件.

https://www.eeworm.com/dl/532/368825.html

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VHDL/FPGA/Verilog fredivn.vhd 偶数分频 fredivn1.vhd 奇数分频 frediv16.vhd 16分频 PULSE.vhd 数控分频器

fredivn.vhd 偶数分频 fredivn1.vhd 奇数分频 frediv16.vhd 16分频 PULSE.vhd 数控分频器

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VHDL/FPGA/Verilog pulse_sequence.vhd 并行脉冲控制器 light.vhd.vhd 交通脉冲控制器 division1.vhd 电压脉冲控制器中的分频 ad.vhd 电压脉冲控制器中的A/D控制

pulse_sequence.vhd 并行脉冲控制器 light.vhd.vhd 交通脉冲控制器 division1.vhd 电压脉冲控制器中的分频 ad.vhd 电压脉冲控制器中的A/D控制 code.vhd 电压脉冲控制器中的脉冲运算模块 voltage2.bdf 电压脉冲控制系统

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