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【摘要】提出了在组播应用中满足多个约束条件的一种组播路由算法。该算法以最短路径算法为基础，通过调整当前形成的路由树中节点的排列顺序，依次为目的节点选择到路由树的最短路径并加入到该路由树中，得到满
2024-02-01 03:30:01
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优秀科普系列之《第一推动》丛书中的书籍之一。
2013-06-04 11:40:01
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数学是什么，经典数学名著，1985年版，经得住时间考验的著作。
2013-12-20 07:05:23
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优秀科普系列之《第一推动》丛书中的书籍之一。
2024-10-10 03:20:01
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分析现有路由算法的缺点，对蚁群系统工作模型和传送网多约束电路路由选择原则进行描述，指出传统蚁群系统在解决多约束路由选择问题中的不足，改进了传统蚁群系统。阐述采用改进后的蚁群系统的多约束电路路由选择算法
2024-02-26 04:30:01
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一种异步串行通信接口信号.RS485是一种通信接口，里面的信号类似于一种差分信号，两个电平的差值大概是200mV左右，抗干扰性能比较好。
2024-05-12 12:50:01
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针对目前导航系统中重要的多约束条件下路径规划功能，结合A*算法和蚁群算法提出一种新的不确定算法，该算法首先将多约束条件进行融合使其适合蚁群转移
2013-11-01 20:08:01
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软件开发过程方法
软件开发过程是什么
RUP是什么
ISO9001是什么
CMM是什么
UML是什么
XP是什么
软件开发过程的比较
测试在软件开发过程中的地位
2015-08-17 10:51:01
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fpga时序约束.rar
2013-09-04 15:00:02
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约束最优化，我想换点MATLAB应用程序，
2015-05-07 00:16:02
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时钟约束实验，在xilinx公司的spartan 3E板上通过控制按钮开关来实现对LED的控制
2013-12-23 02:22:07
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Synopsys' widely-used design constraints format, known as SDC, describes the "design intent" and surrounding constraints for synthesis, clocking, timing, power, test and environmental and operating co
2018-07-13 14:35:29
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该文档为Vivado时序约束介绍，是一份不错的参考文档，可以看一看。
2022-12-14 13:40:02
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华为Verilog约束，很好的资料，欢迎下载
2023-01-18 14:10:02
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PID调节的实质是什么？
经常看到有关PID调节问题书籍，看来看去看不懂他们再说什么。还有一些技术员一提起PID调节，就摇头，搞不懂呀！那么PID调节的实质是什么？通俗的概念是什
2024-04-01 12:40:01
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fpga时序约束.rar
2015-01-21 00:48:01
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综合命令,约束语句
2015-02-27 00:24:02
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约束最优化2，我想换点MATLAB应用程序，
2013-11-28 05:22:04
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时序路径
时序路径由设计中instance之间的连接决定。在数字设计中，时序路径由一对时序元作sequential elements）形成，这对时序元件由一个或二个不同的时钟控制。
普通时序路径
在任何设计中最普通的时序路径有以下4种：
1输入端口到内部时序单元路径
2从时序单元到时序单元之间的内部路径3从内部时序单元到输出端口之间
2022-06-16 07:30:04
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FPGA时序约束培训，非常有价值的资料，FPGA的爱好者和开发者可以参考下
2022-10-18 06:20:02
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