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基于FPGA的SATA2接口视频采集
本课题结合现有的各种视频传输系统，在综合分析了各种传输接口的速度要
求、实现成本、适用性等指标的基础上，考虑采用SATA2作为传输接口，并以
DDR2 SDRAM作为图像数据缓存器件，Xilinx公司的
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基于单片机控制的FPGA芯片数据加载
为了解决FPGA数据加载所面临的问题,提出了采用单片机控制的FPGA数据加载方法.并以80C188EC微处理器对Xilinx公司XCS10型FPGA芯片数据的串行加载为例,解决了采用单片机控制对FPGA
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板级光互连协议研究与FPGA实现
实现的过程中，采用了Xilinx公司的ISE(Integrated System Environment,集成开发环境)开发流程，使用的设计工具包括:ISE，ModelSim，Synplify Pro,
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板级光互连协议研究与FPGA实现.rar
实现的过程中，采用了Xilinx公司的ISE(Integrated System Environment,集成开发环境)开发流程，使用的设计工具包括:ISE，ModelSim，Synplify Pro,
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板级光互连协议研究与FPGA实现
实现的过程中，采用了Xilinx公司的ISE(Integrated System Environment,集成开发环境)开发流程，使用的设计工具包括:ISE，ModelSim，Synplify Pro,
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modelsim教程(中文)
ModelSim分几种不同的版本：SE、PE和OEM，其中 集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA厂商设计工具中的均是其OEM版本。
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modelsim教程(中文)
ModelSim分几种不同的版本：SE、PE和OEM，其中 集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA厂商设计工具中的均是其OEM版本。
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四路同步数据采集和处理系统的设计
信号处理单元的设计以Xilinx ISE为软件平台，采用VHDL和IP核的方法，设计了时钟产生模块、数据滑动模块、FFT运算模块、求模运算模块、信号控制模块，完成信号处理单元的设计，并采用ModelSim
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四路同步数据采集和处理系统的设计
信号处理单元的设计以Xilinx ISE为软件平台，采用VHDL和IP核的方法，设计了时钟产生模块、数据滑动模块、FFT运算模块、求模运算模块、信号控制模块，完成信号处理单元的设计，并采用ModelSim
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基于FPGA的四路同步数据采集和处理系统的设计.rar
信号处理单元的设计以Xilinx ISE为软件平台，采用VHDL和IP核的方法，设计了时钟产生模块、数据滑动模块、FFT运算模块、求模运算模块、信号控制模块，完成信号处理单元的设计，并采用ModelSim
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基于FPGA的全数字QPSK通信系统的研究.rar
本文是对基于FPGA的全数字QPSK通信系统进行了研究，首先讨论了QPSK通信系统的基本原理，并用Matlab仿真系统的误码率，其次，采用VHDL在XILINX公司ISE6.1开发环境下对系统的FPGA
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Cyclone V FPGA：采用低功耗28nm FPGA减少总系统成本
Cyclone V FPGA的一个很明显的特性，也可以说是一个很大的优势，即：采用低功耗28nm FPGA减少总系统成本
![<em class=]()
xilinx
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XAPP424 - 嵌入式JTAG ACE播放器
This application note contains a reference design consisting of HDL IP and Xilinx AdvancedConfiguration
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CPLD器件在两相混合式步进电动机驱动器中的应用
文章详细介绍了一种以Xilinx 公司生产的CPLD 器件XC9536 为核心来产生电机绕组参考电流, 进
而实现具有绕组电流补偿功能的两相混合式步进电动机10 细分和50 细分运行方式的方法。
而实现具有绕组电流补偿功能的两相混合式步进电动机10 细分和50 细分运行方式的方法。
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Cyclone V FPGA：采用低功耗28nm FPGA减少总系统成本
Cyclone V FPGA的一个很明显的特性，也可以说是一个很大的优势，即：采用低功耗28nm FPGA减少总系统成本
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xilinx
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XAPP424 - 嵌入式JTAG ACE播放器
This application note contains a reference design consisting of HDL IP and Xilinx AdvancedConfiguration
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CPLD器件在两相混合式步进电动机驱动器中的应用
文章详细介绍了一种以Xilinx 公司生产的CPLD 器件XC9536 为核心来产生电机绕组参考电流, 进
而实现具有绕组电流补偿功能的两相混合式步进电动机10 细分和50 细分运行方式的方法。
而实现具有绕组电流补偿功能的两相混合式步进电动机10 细分和50 细分运行方式的方法。
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赛灵思 FPGA 设计时序
赛灵思 FPGA 设计时序：作为赛灵思用户论坛的定期访客（见
http://forums.xilinx.com），我注意到新用
户往往对时序收敛以及如何使用时序约束
http://forums.xilinx.com），我注意到新用
户往往对时序收敛以及如何使用时序约束
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基于FPGA的JPEG压缩编码的研究与实现.rar
方案采用了IP核复用的设计技术，基于Xilinx公司本身的IP核，进行了再次开发。在研究JPEG标准的核心算法DCT的基础上，加以改进，设计了适合器件结构的基于DA算法的DCT变换的IP核。
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基于FPGA的RS码编译码器的设计与实现
本文针对南京航空航天大学自行研制的微小卫星通信分系统的技术要求，在用SystemView和C语言仿真的基础上，用硬件描述语言Verilog设计了RS（255，223）编码器和译码器，使用Modelsim软件进行了功能仿真，并通过Xilinx