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用Verilog 实现的电子时钟，给初学者一个模版，学习Verilog。
2016-10-02 00:02:01
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Verilog语言编写的电话计费系统，这只是源代码，需要在quartusII等软件下运用
2014-01-10 14:22:02
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128Mb DDR verilog源程序
2016-10-12 10:22:02
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arm7内核的verilog代码，可以综合，虽有几条指令没有实现，但已实现的功能对理解arm体系结构已足够
2016-10-13 00:32:02
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周立功Verilog HDL黄金参考指南，学习VerriLog的东西。
2014-01-17 22:15:02
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verilog入门知识以及练习题，硬件描述语言是硬件设计人员和电子设计自动化工具之间的界面其主要目的是用来编写设计文件建立电子系统行为级的仿真
模型
2016-10-26 10:15:02
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华为的FPGA和Verilog的教程，我相信对大家的用处是毋庸置疑的。
2013-12-05 06:40:02
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用Verilog语言写的FPGA FIFO，仅供参考。
2014-01-20 03:13:11
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SPI串行总线接口的Verilog实现，详细讲解实现过程。
2014-12-08 21:35:02
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延迟线模块的verilog代码，延迟线模块是数字电路设计常用的模块
2016-11-18 20:35:01
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通用异步FIFO设计的verilog代码，来自于opencore
2016-11-18 20:36:02
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UART串口的传送verilog原程序，已经经过了编译仿真
2014-01-14 02:35:01
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PIC单片机的verilog实现，不记得在哪里下载的。源文件中应该有的。
2013-12-13 18:14:01
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sdram 控制器的verilog 实现，包括用户逻辑和控制器的设计
2013-12-12 04:44:02
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verilog的非常好的材料，是verilogHDL编码风格的总结。
2013-12-18 01:22:09
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Verilog作业 ：自己写的源码输入，补码输出的，由状态机控制的四位加法器，为保证时序，加法器模块为超前近位加法器，包含测试台，通过 Modelsim 、Synplify仿真。
2014-01-21 06:56:01
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arm 7 verilog code used setup soc
2016-12-17 00:24:02
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verilog编写的异步fifo源代码，asyn_fifo.v为顶层，调用其他四个文件
2014-01-11 16:53:01
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Verilog的135个经典设计实例，直流电机控制，游戏机，三态总线，加法器，锁存器等
2013-12-09 08:44:17
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实现累加器的verilog源码，广泛应用在通信电路设计中
2013-12-16 03:01:01
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