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ALDEC公司的Active-HDL是一个开放型的仿真工具。 可支持几乎所有的FPGA/CPLD厂商的产品，设计输入可以原理图或硬件描述语言或有限状态机 方式
2013-05-29 08:30:01
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Verilog HDl代码，学习一颗看一下
2013-08-19 23:30:01
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基于可变时的HDL交通灯设计
2013-10-16 22:56:02
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叫你如何拥有良好的编码风格
2013-11-06 17:20:01
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基于可变时的HDL交通灯设计
2013-10-11 08:48:01
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叫你如何拥有良好的编码风格
2014-01-04 05:07:11
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Verilog HDL程序，对硬件开发有兴趣或需要的朋友赶快down下来
2014-12-09 00:06:03
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HDL编程风格，很有用,希望对大家有所帮助。
2015-06-23 00:37:01
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Verilog HDL课件，有常见问题说明
2013-12-21 05:35:06
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verylog hdl教程，硬件编程语言，简单易学，它的语法比起VHDL来说没有那么严格，很适合初学者学习，如果你有C，pascal或者其他语言的基础应该能很快学习入门，本人还有VHDL的视频教程，有意者可以联系我
2014-01-01 19:36:10
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Verilog HDl代码，学习一颗看一下
2014-01-15 05:21:01
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verilog HDL语言，对于超大规模集成电路开发学习非常有好处
2016-10-15 20:33:02
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Verilog HDL源码，显示器段数码管数字累加，测试通过
2016-11-23 10:20:02
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verilog HDL语言，线性CCD1501D驱动程序，基于FPGA，其他线性传感器可参照修改。
2017-04-08 10:49:01
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Verilog HDL经典教程，介绍Verilog的语法结构，用Verilog进行数字系统设计的流程及经典案例。
2018-10-13 13:27:38
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2022-09-26 22:50:02
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Verilog HDL教程，以及相应的源码，适用于初学者的学习
2023-02-21 22:10:02
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ALDEC公司的Active-HDL是一个开放型的仿真工具。可支持几乎所有的FPGA/CPLD厂商的产品，设计输入可以原理图或硬件描述语言或有限状态机方式。
2023-02-24 08:40:02
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，于近日宣布Active-HDL最新版本-Active-HDL 8.1，已于2008年09月11日正式上市。Active-HDL是集成VHDL，Verilog，EDIF，System C开发环境。
2023-04-16 17:50:02
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ALDEC公司的Active-HDL是一个开放型的仿真工具。 可支持几乎所有的FPGA/CPLD厂商的产品，设计输入可以原理图或硬件描述语言或有限状态机 方式
2023-06-06 15:50:07
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