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应用文档，方便理解Altera i/O 输出时间，如何定义Tco,以及计算用户系统输出时间的方法！
2013-12-22 18:13:06
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2级流水线实现的8位全加器的VHDL代码，适用于altera系列的FPGA/CPLD
2014-06-15 22:59:03
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assumes that you have a JTAG parallel cable connected to your PC
// Works with Xilinx parallel III or Altera
2014-01-17 09:02:01
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FPGA开发板的原理图很详细的，主要是ALTERA公司的CYCLONE，用protel画的，
2013-12-19 06:26:01
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ISA板卡，CPLD原理图，altera maxII CPLD芯片。实现运动控制，标准安川伺服器控制接口。
2017-01-06 20:42:02
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VHDL编写的6层电梯控制器，可在Altera的CPLD系统运行实验，内附实验报告
2014-01-22 05:07:02
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基于Altera公司的FPGA开发板DE0实现计时、秒表、倒计时功能的数字时钟
2025-02-10 20:40:02
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一个有趣的、易用的、直观的、可自由定制的白板软件是什么样的？深圳市艾博德科技有限公司强势推出的DrawView V3.0将带给你全新的体验。
2013-06-16 16:40:01
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对CAN 是什么、CAN 的特征、标准规格下的位置分布等、CAN 的概要及CAN 的协议进行了说明。
2022-11-23 10:30:02
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一个有趣的、易用的、直观的、可自由定制的白板软件是什么样的？深圳市艾博德科技有限公司强势推出的DrawView V3.0将带给你全新的体验。
2023-06-06 20:50:03
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一个有趣的、易用的、直观的、可自由定制的白板软件是什么样的？深圳市艾博德科技有限公司强势推出的DrawView V3.0将带给你全新的体验。
2014-03-30 12:22:13
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8051 MCU在nois平台上实现的说明文档，讲解非常详细，对于设计很有帮助，出自Altera公司。
2014-01-11 12:36:02
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文章论述如何将向modelsim中添加仿真库，包括添加xilinx,altera,actel公司的仿真库的方法
2013-12-31 05:19:01
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利用触发器实现的，8位半加器的VHDL语言实现，适用于altera系列FPGA
2016-01-27 10:45:02
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FPGA开发入门的Verilog HDL程序2---梁祝音乐播放,真实可用，验证通过，工程环境为Altera Quartus II
2014-01-09 06:58:09
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Verilog 编写的ISP1362的控制器IP核，altera公司DE2系统中的源程序
2016-09-17 10:53:02
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SOPC架构建立实例，针对altera公司的DE2开发板，其他开发系统也可以用
2014-06-22 01:00:14
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该文档为Quartus-II-13.1与自带modelsim-Altera-10.0d仿真软件的联调，不错的资料
2023-01-02 06:40:02
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基于altera 的cyclone 做的频率计源码，使用的是verilog进行编写，eda工具是quartus ii 12.0
2023-03-02 19:00:04
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这是altera给的sdram控制器的一个标准代码，非常具有参考价值~~值得借鉴~~
2024-12-06 09:20:02
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