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基于CPLD/FPGA的IP核设计
本文介绍了一个基于CPLD／FPGA的嵌入式IP核设计。论文在阐述可编程逻辑器件及其发展趋势的基础上，探讨了知识产权复用理念，MCU的复杂化设计以及数字信号传输与处理的速度要求。
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verilog 实现FFT IP核的控制
verilog 实现FFT IP核的控制 verilog 实现FFT IP核的控制
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DW8051IP核扩展设计
DW8051 IP核扩展设计，增加了jtag接口，可通过jtag下载程序并运行；增加了两个IO端口porta、portb。在QuartusII 11下验证通过。
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基于FPGA的8051 IP核的设计
本文探索了自主系统CPU设计方法和经验，同时对80C51产品进行了必要的改进。 文章采用XILINX公司的Virtex-ⅡPro系列FPGA芯片，在相关EDA软件平台的支持下进行基于FPGA的8051芯片的设计。在已公开的8051源代码的基础上，对其中的程序存储器、指令存储器做了较大幅度的修改，增加了定时器、串行收发器的软件编写，VerilogHDL语句共6000余行(见附录光盘)。在设计中笔者特
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这是一个fft的IP核
这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。