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Verilog HDL 华为入门教程

Verilog HDL 华为入门教程
2013-10-10 08:08:01 下载 189 查看 1,150
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Verilog HDL程序设计教程

Verilog HDL程序设计教程
2013-11-22 08:52:02 下载 62 查看 1,103
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verilog testbench设计技巧和策略

verilog testbench设计技巧和策略
2013-11-01 10:00:01 下载 158 查看 1,145
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Verilog HDL的基础知识

学习FPGA的必备知识
2014-12-28 20:26:01 下载 189 查看 1,129
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夏宇闻Verilog经典教程

夏宇闻Verilog经典教程
2013-11-01 03:48:01 下载 50 查看 1,099
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掌握Verilog的设计利器

第二讲：掌握Verilog的设计利器
2013-10-21 15:24:01 下载 77 查看 1,036
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76例程源码—verilog

verilog的76个例子
2013-10-30 19:24:01 下载 128 查看 1,146
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一些Verilog学习程序A

这是一些设计程序，如果你会一些调试方面的东西，把这个看懂了，结合硬件就可以实现了
2013-11-25 10:36:01 下载 40 查看 1,062
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Verilog HDL 华为入门教程

Verilog HDL 华为入门教程
2013-10-31 06:48:01 下载 129 查看 1,143
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Verilog HDL程序设计教程

Verilog HDL程序设计教程
2013-11-06 18:24:02 下载 26 查看 1,057
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verilog testbench设计技巧和策略

verilog testbench设计技巧和策略
2013-12-24 04:46:02 下载 22 查看 1,082
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Verilog HDL的基础知识

学习FPGA的必备知识
2013-11-10 12:24:01 下载 162 查看 1,081
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夏宇闻Verilog经典教程

夏宇闻Verilog经典教程
2013-10-21 05:24:01 下载 72 查看 1,240
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Verilog Coding Style for Efficient Digital Design

 

In this paper, we discuss efficient coding and design styles using verilog.
2013-11-23 02:48:01 下载 54 查看 1,059
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Design Safe Verilog State Machine（Synplicity）

 

One of the strengths of Synplify is the Finite State Machine compiler. This is a powerfulfeature that not only has the ability to automatically detect state machines in the sour
2013-10-20 14:40:01 下载 20 查看 1,253
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本文为verilog的源代码

本文为verilog的源代码
2015-01-08 00:23:01 下载 195 查看 1,063
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sdram的verilog的源码实现

sdram的verilog的源码实现
2015-01-09 00:18:01 下载 33 查看 1,074
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PCI接口的Verilog源代码

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2013-12-28 07:58:01 下载 84 查看 1,092
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Verilog Coding Style for Efficient Digital Design

Verilog Coding Style for Efficient Digital Design
2015-01-21 00:47:02 下载 91 查看 1,126
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verilog写的回波抵消程序

verilog写的回波抵消程序，相当于写了个回波抵消的芯片，不是dsp，可编译后下载于FPGA,绝对原创，写了很长时间。
2014-01-09 19:09:11 下载 178 查看 1,158
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