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整个译码器模块的设计采用Verilog语言描述，并在VirtexⅡPro系列FPGA芯片上实现。
2023-11-01 07:00:01
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其次设计了基于WinCE操作系统的图像采集、GPIO、PWM、外中断EINT-19的流接口驱动程序；同时设计了基于WinCE操作系统的图像采集及压缩、网络通信、车模速度采集的应用程序；FPGA内部逻辑电路采用Verilog
2023-11-10 02:50:01
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其次,参照IEEE 802.15.3协议标准,设计了(2,1,6)卷积码Viterbi译码器,采用串行方式进行回溯译码,利用双口RAM存储路径度量和幸存信息.电路使用Verilog HDL语言进行描述,
2024-01-05 08:20:01
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整个译码器模块的设计采用Verilog语言描述，并在VirtexⅡPro系列FPGA芯片上实现。
2024-01-06 19:40:01
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公司的嵌入式可编程接口芯片Q15030来完成接口芯片设计.QL5030内集成了PCI接口控制器和用户可编程逻辑FPGA.该设计在深刻理解PCI协议的基础上,在用户可编程逻辑FPGA上,应用硬件描述语言VHDL、Verilog
2024-01-13 07:50:01
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针对某工程应用中的具体要求，我们以FPGA为平台，采用Verilog HDL语言对改进算法进行了硬件实现。
2024-02-19 18:00:02
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针对这一现象，通过认真分析PROFIBUS-DP总线协议，本文设计并完成了一种通过FPGA器件，采用硬件描述语言Verilog HDL实现PROFIBUS-DP从站协议功能的方案。
2024-03-02 02:40:01
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本文的所有逻辑模块均采用Verilog HDL语言进行描述设计。 本文最后对系统进行了调试。经实验验证，系统达到了图像实时采集、存储的功能，能进行正确可靠的工作。
2024-03-04 11:50:01
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通过对运动控制器算法的建模，采用Verilog HDL硬件描述语言对模型进行描述，由此构建IP软核，并通过软件测试仿真验证其正确性，最后介绍了在FPGA芯片实现精插补的策略。
2024-04-05 06:40:01
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针对这个问题，探讨了如何利用目前现有器件进行系统实现，提出基于FPGA的全数字设计模型，并设计了简化的两级结构同步捕获算法的系统实现方案，用Verilog HDL编写了关键逻辑电路模块。
2024-05-09 21:00:01
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幸运的是，即使你不会51单片机，Ration也可以带领你彻底征服这个看似复杂实则简单的单片机
不管是什么单片机，本质上都一样，对外表现为N个引脚，用引脚的高低电平变化来完成各种控制通信工作。
2022-04-02 20:30:01
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从调试到现在已经烧毁了5片stm32都是cpu短路，等有空查查是什么原因。
2022-06-10 17:30:01
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随后，又详细地介绍了芯片中虚级联技术的实现、LCAS状态机、时钟使能控制模块、开销处理等部分的设计，并使用Verilog HDL的可综合子集实现了各部分的RTL级硬件描述，并按照功能要求编写测试平台给出了仿真结果
2023-09-28 10:50:01
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10. viterbi decoder , use verilog HDL language..
11. 三星ARM试验箱.
12. USB JTAG 卡.
2015-04-24 09:50:56
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介绍了如何用VERILOG代码实现URAT。.
3. 此程序为C51编程的OCM12864点阵汉字液晶显示.
4. 24C64 EEPROM读写的C语言程序.
5.
2015-04-24 09:50:58
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集散控制系统(Distributing Control System，缩写DCS)是以多个微处理机为基础利用现代网络技术、现代控制技术、图形显示技术等实现对分散控制系统的调节、监视的控制技术。
2013-04-24 16:38:19
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在软件无线电思想的指导下，本文利用System Generator软件完成了基于QRD_RLS算法的记忆多项式法的数字预失真的FPGA设计，并且在硬件平台上检验了预失真效果。
2013-04-24 16:38:21
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音频管理组件(Audio Management Unit，AMU)是先进客舱娱乐与服务系统(Advanced Cabin Entertainment Service System，ACESS)的组成部分
2013-08-06 08:30:02
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实现的过程中，采用了Xilinx公司的ISE(Integrated System Environment,集成开发环境)开发流程，使用的设计工具包括:ISE，ModelSim，Synplify Pro,
2013-06-28 18:50:02
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根据MPEG-2中关于System Packet的定义，针对FPGA可实现性，以空间换取复杂度的减少，实现了PES包的打包模块。
2013-07-22 17:50:01
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