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It guides students to master the development process of the SCM system step by step and the platform
2023-10-10 06:20:01
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Firstly,the hardware structure of the system is designed through the main controller,inertial measurement
2023-10-13 00:40:01
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汽车防抱死制动系统(anti-lock braking system, abs)作为一种新型的主动安全装置，能够在汽车紧急制动时防止车轮发生抱死现象，从而可以有效地提高汽车的制动稳定性、缩短制动距离，减少交通事故发生率
2023-12-14 14:00:02
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在FPGA硬件系统的设计开发中，运用了Xilinx公司最新的FPGA系统级丌发工具包System Generator。
2024-03-08 00:30:01
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最近几年，随着电子设计自动化(Electronic Design Automation)技术的迅速发展，使得基于FPGA的可编程片上系统(System On a Programmable Chip)逐渐成为嵌入式系统
2024-04-08 16:40:01
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@@ 随着FPGA的开发技术日趋简单化、软件化，从面向硬件语言的VHDL、VerilogHDL设计语言，到现在面向对象的System Verilog、SystemC设计语言，硬件设计语言开始向高级语言发展
2013-04-24 16:38:21
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随着GPS(Global Positioning System)技术的不断发展和成熟，其全球性、全天候、低成本等特点使得GPS接收机的用户数量大幅度增加，应用领域越来越广。
2013-04-24 16:38:38
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随着GPS(Global Positioning System)技术的不断发展和成熟，其全球性、全天候、低成本等特点使得GPS接收机的用户数量大幅度增加，应用领域越来越广。
2023-06-09 02:20:35
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@@ 随着FPGA的开发技术日趋简单化、软件化，从面向硬件语言的VHDL、VerilogHDL设计语言，到现在面向对象的System Verilog、SystemC设计语言，硬件设计语言开始向高级语言发展
2023-06-27 12:00:03
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使用verilog语言控制CPLD通过红外收发器进行红外通讯.
25. protel绘制的图片.
26. 简单易懂GUI的用法.
27. zigbee无线网络源码包.
2015-04-24 09:51:01
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对电力电子系统网络（Power Electronics System Network，PES—Net）的模型和变流系统的通信需求进行分析，提出实时电力电子系统网络（Real—time power electronics
2013-06-15 23:20:01
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default:
system
2020-06-11 00:08:57
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对电力电子系统网络（Power Electronics System Network，PES—Net）的模型和变流系统的通信需求进行分析，提出实时电力电子系统网络（Real—time power electronics
2023-09-15 15:00:02
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在这个草根时代，写本书也不
是什么大不了的事情。
在确认了写书的目标后，匠人就这本书的内容和文风进行了思考。匠人究竟应该写一本怎样的书？作为作者的匠人，和作为读者的您，我们究竟需要什么？
2022-06-23 19:50:02
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使用Verilog硬件描述语言设计并实现了FPGA内部采集数据管理、数据管理寄存器和FIFO数据缓冲队列等模块电路。利用ModelSim对PCI系统进行了仿真。
2013-07-27 08:10:01
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在ⅡR实现方面，本文采用Verilog HDL语言编写了相应的硬件实现程序，将内置SignalTap Ⅱ逻辑分析器的ⅡR设计下载到FPGA芯片，并利用Altera公司的SignalTap Ⅱ逻辑分析仪进行了定性测试
2013-04-24 16:38:22
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使用Verilog硬件描述语言设计并实现了FPGA内部采集数据管理、数据管理寄存器和FIFO数据缓冲队列等模块电路。利用ModelSim对PCI系统进行了仿真。
2013-07-22 21:20:01
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在对硬件描述语言以及FPGA设计流程深入理解的基础上，利用Verilog语言实现了双环PI控制器和PWM发生电路的数字化，使得有源电力滤波器补偿精度提高，有更好的可修改性，可使用于很多不同的非线性负载。
2013-07-27 18:50:01
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然后，基于Verilog HDL 设计出12位固点数据的Turbo编译码器以及仿真验证平台，与用Matlab语言设计的相同指标的浮点数据译码器进行性能比较，得到该设计的功能验证。
2013-04-24 16:38:35
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本文使用硬件描述语言Verilog，以RedLogic的RVDK开发板作为硬件平台，在开发工具OUARTUS2 6.0和MODELSIM SE 6.1B环境中完成软核的设计与仿真验证。
2013-04-24 16:38:36
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