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The design of the pipeline leak detection and alarm system with AT89 C51 as the control core,the
2023-09-23 11:20:01
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Through the design and optimization analysis of the temperature control system in the electric heating
2023-09-25 23:40:01
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the long press of S1.and UV disinfection will be carried out regularly every day.Through the test,the system
2023-10-04 15:50:01
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combination of virtual and real teaching methods and so on are implemented,the multi-level practical system
2023-10-09 05:00:02
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当前在可穿戴计算工程中有十几项关键技术，如微型处理器、无线自组网、System-on-Chip(一个芯片一台机)、无线通讯、嵌入式操作系统等都是当前计算机科学的难关。
2024-04-25 00:40:01
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论文主要内容包括绪论、监控系统、单端反激变换器、电路调试与实验结果.监控系统采用了由美国国家半导体公司最新推出的COP8CDR9单片机,它内部带有32K闪存,1K RAM,并且支持在线系统编程技术(In-system
2025-01-16 21:40:01
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主要研究以下几个方面的内容： 1.基于端口电路信号寄存器的采集和输出方式，本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7]，并完成了Verilog XL和Hspiee的功能和时序仿真
2013-07-20 18:30:02
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主要研究以下几个方面的内容： 1.基于端口电路信号寄存器的采集和输出方式，本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7]，并完成了Verilog XL和Hspiee的功能和时序仿真
2013-06-03 20:00:02
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主要研究以下几个方面的内容： 1.基于端口电路信号寄存器的采集和输出方式，本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7]，并完成了Verilog XL和Hspiee的功能和时序仿真
2023-10-02 06:00:02
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主要研究以下几个方面的内容： 1.基于端口电路信号寄存器的采集和输出方式，本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7]，并完成了Verilog XL和Hspiee的功能和时序仿真
2024-05-11 02:00:03
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@@ 5．完成了激光打印机逻辑控制系统的软件设计与实现，采用Verilog硬件描述语言在Quartus Ⅱ 6．0软件平台下进行开发，对逻辑控制系统进行了仿真及调试。
2023-09-27 02:40:01
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本文以OFDM技术和跳频技术为核心理论，在Xilinx公司的集成开发环境ISE6.2中，主要采用硬件描述语言(Verilog、VHDL)编程，辅以调用IP核和采用原理图输入方式，设计实现了一个FH-OFDM
2023-09-27 04:50:01
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本设计采用Verilog HDL硬件描述语言进行设计，基于Xilinx公司的Virtex-4XC4VSX35芯片。
2013-07-09 15:40:01
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本设计采用Verilog HDL硬件描述语言进行设计，基于Xilinx公司的Virtex-4XC4VSX35芯片。
2013-06-13 23:30:02
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ASIC-〉FPGA
FPGA分类、结构、设计流程，FPGA设计工具：
VHDL
Verilog
2013-11-06 04:48:01
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ASIC-〉FPGA
FPGA分类、结构、设计流程，FPGA设计工具：
VHDL
Verilog
2013-11-10 21:24:01
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本设计采用Verilog HDL硬件描述语言进行设计，基于Xilinx公司的Virtex-4XC4VSX35芯片。
2023-10-02 09:20:01
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在对内交织和解内交织各个子模块进行C语言和MATLA8算法仿真的基础上，完成了内交织和解内交织总模块的FPGA设计，系统所有的硬件电路设计都采用了Verilog HDL语言编写。
2023-10-11 20:30:02
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课题的主要研究内容包括，基于FPGA的可重构系统硬件电路设计，系统异步接收器模块、FLASH存储器读写控制器模块、FPGA配置模块、FPGA控制ADC采样模块和E2pROM存储器读写控制器模块的Verilog
2023-10-12 11:50:01
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在对内交织和解内交织各个子模块进行C语言和MATLA8算法仿真的基础上，完成了内交织和解内交织总模块的FPGA设计，系统所有的硬件电路设计都采用了Verilog HDL语言编写。
2023-12-29 10:40:01
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