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口之间的数据通道的HEC头校验的FPGA实现.并完成了硬件设计、配置、硬件测试联调工作以及论文撰写工作.硬件的设计和开发基于Protel99和Tornado/VxWorks,软件的设计和开发采用了标准的VHDL
2013-07-08 15:30:01
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完成系统设计及模块划分后，使用硬件描述语言(VHDL)描述系统，并验证设计的正确性。
2013-07-15 01:10:01
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介绍了Verilog HDL语言的起源，以及Verilog HDL语言的优缺点，并与VHDL语言进行了简单的比较。 第三章介绍嵌入式系统要实现的经过剪裁的TCP/IP协议栈的内容。
2013-04-24 16:38:35
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但是SDRAM却具有复杂的时序，为了降低成本，所以采用目前很为流行的EDA技术，选择可编程逻辑器件中广泛使用的现场可编程门阵列FPGA，使用硬件描述语言VHDL，遵循先进的自顶向下的设计思想实现对SDRAM
2013-07-11 13:20:01
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介绍了TCDI501C线阵CCD的驱动电路设计，详细介绍了用VHDL完成的CCD图像传感器驱动时序设计和视频输出差分信号驱动电路的设计。
2022-06-23 06:50:02
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Altium Designer6.9是Altium公司的桌面板级电路设计系统，它集原理图设计输入、PCB设计绘制、模拟电路仿真、数字电路仿真、VHDL
2022-08-15 04:00:02
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为了体现Altium的高端分析功能，《Altium Designer 14电路设计与仿真从入门到精通》特意讲解了FPGA、VHDL编程等相关知识；最后通过各个方面的实例应用介绍，让读者在掌握电路绘图技术的基础上学会电路设计的一般方法和技巧
2022-09-08 12:20:02
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为了体现Altium的高端分析功能，《Altium Designer 14电路设计与仿真从入门到精通》特意讲解了FPGA、VHDL编程等相关知识；最后通过各个方面的实例应用介绍，让读者在掌握电路绘图技术的基础上学会电路设计的一般方法和技巧
2022-09-08 12:30:01
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但是SDRAM却具有复杂的时序，为了降低成本，所以采用目前很为流行的EDA技术，选择可编程逻辑器件中广泛使用的现场可编程门阵列FPGA，使用硬件描述语言VHDL，遵循先进的自顶向下的设计思想实现对SDRAM
2023-06-11 14:00:32
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介绍了Verilog HDL语言的起源，以及Verilog HDL语言的优缺点，并与VHDL语言进行了简单的比较。 第三章介绍嵌入式系统要实现的经过剪裁的TCP/IP协议栈的内容。
2023-06-12 17:31:18
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然后以Xilinx公司的ISE10.1为软件平台，利用VHDL描述的方式，并以FPGA(现场可编程门阵列)芯片SPARTAN-3E为硬件平台，研究实现了适用于IEEE802.11a和IEEE802.11n
2023-09-29 00:00:02
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本文采用VHDL硬件描述语言、XILINNX公司的ISE集成开发环境以及ModelSim XE Ⅲ 6.0a仿真工具构建了以FPGA作为处理器的读卡器与智能卡之间的通信系统，并且通过多次仿真、验证，实现了设计方案
2023-09-30 05:30:01
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完成了各模块VHDL代码编写、仿真和调试。对设计FIR滤波器所使用的分布式算法进行了改进。使用并串结构以及OBC编码以提高速度，减少FPGA资源消耗。
2023-09-30 15:30:02
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介绍了Verilog HDL语言的起源，以及Verilog HDL语言的优缺点，并与VHDL语言进行了简单的比较。 第三章介绍嵌入式系统要实现的经过剪裁的TCP/IP协议栈的内容。
2023-09-30 20:10:01
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基于上述方案，完成了VHDL语言编程，并完成仿真调试及验证。最后，总结全文，提出下一步研究工作的方向。
2023-10-02 01:50:01
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采用 VHDL 语言编程实现了算法，其中代码通过了时序仿真，并下载到具体的芯片中进行了验证。实验结果表明这种方法是可行的。
2023-10-02 07:30:01
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但是SDRAM却具有复杂的时序，为了降低成本，所以采用目前很为流行的EDA技术，选择可编程逻辑器件中广泛使用的现场可编程门阵列FPGA，使用硬件描述语言VHDL，遵循先进的自顶向下的设计思想实现对SDRAM
2023-10-04 07:00:01
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针对于具体的FPGA硬件实现，本文采用了硬件描述语言VHDL来完成设计。通过对译码器的综合仿真和FPGA实现验证了该方案的可行性。译码器的最高译码输出速率可以达到60Mbps。
2023-10-04 12:30:01
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3．使用VHDL设计的恒模盲多用户检测模块通过MUX+PLUSⅡ软件中的编译器编译成功，得到报告文件，对报告文件中系统占用硬件资源信息做了分析。
2023-10-05 02:40:01
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2．编写VHDL程序，实现FPGA内部逻辑功能，在一定的时间内，对雷达信号采集参数，计算出各个脉冲的脉宽，以及各个脉冲到达时间。
2023-10-07 00:30:01
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