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设计选用硬件描述语言VerilogHDL和VHDL，在开发工具Xilinx ISE7.1中完成整个系统的设计、综合、布局布线，利用Modelsim进行功能及时序仿真，使用DriverWorks为SCI串行通信接口编写
2023-09-30 14:00:01
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该设计采用了Altera公司Cyclone系列的EP1C3T144C8 FPGA,在Quartus Ⅱ集成环境下用VHDL硬件描述语言实现。
2023-10-01 19:20:01
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此外，由于FPGA通过软件方式实现整个信息采集系统的接口和时序控制的功能，所以本文第四章专门讨论了使用VHDL语言在FPGA内实现的数据采集、数据通讯、格式转换以及时序控制等功能，并在ISE7.1开发环境下对所设计的软件进行了
2023-10-03 13:10:01
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介绍了应用VHDL语言和嵌入式微控制器IP核的软件编程。并对FPGA控制偏振控制器的方案及实验进行了详细分析。
2023-10-03 22:40:02
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论文的工作重点主要有以下几个方面的内容：FPGA及VHDL语言的研究，ATA协议标准研究及IDE接口的FPGA实现。
2023-10-04 00:00:02
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然后，按照层次化、模块化的设计思想，在Xinlinx公司的ISE 7．1工具中，采用硬件描述语言VHDL作为设计输入，对各运算器和控制模块进行电路设计；采用Menter公司的ModelSim SE 6.2b
2023-10-04 02:40:02
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8阶2FSK信号去噪自适应滤波器的模型，结合多种EDA工具，在EPFlOKl00EQC208-1器件上设计出了最高数据处理速度为36.63MHz的8阶LMS自适应滤波器，其速度是文献[3]通过编写底层VHDL
2023-10-31 11:20:01
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低功耗的要求,采用PCI总线进行设计.随着可编程逻辑器件的发展,为在一片PLD芯片内实现复杂的逻辑控制提供了条件.该文在综合比较开发PCI卡的几种方法的基础上,选择了使用FPGA来实现PCI接口卡设计.用VHDL
2024-01-13 03:50:01
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的设计中,首先给出了该设计CPU的指令格式和指令集.指令和指令系统是计算机的基础,也是该文实验系统的基础.然后以"自顶向下"的设计思路按组成将CPU划分为8个相对独立的模块,对每一模块进行了介绍,并用VHDL
2024-01-16 22:30:01
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而现有各种回单机控制系统不能完全达到高可靠性的要求.该文分析了目前已经研制的各种银行回单机控制系统的优缺点的基础上,提出采用PLD(可编程逻辑器件)和EDA技术对银行回单机控制系统进行改进的方案.该设计运用超高速集成电路硬件描述语言VHDL
2024-01-19 12:10:01
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设计过程中，利用了VHDL语言的结构严谨、表达清晰的特点，用高层次的描述语言直接去构造最底层的硬件逻辑结构；又充分利用模块化的设计，发挥了可重用技术的优点，使设计层次分明、硬件结构简洁明了。
2024-01-23 14:40:02
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该设计采用了Altera公司Cyclone系列的EP1C3T144C8 FPGA,在Quartus Ⅱ集成环境下用VHDL硬件描述语言实现。
2024-03-03 03:40:02
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论文的工作重点主要有以下几个方面的内容：FPGA及VHDL语言的研究，ATA协议标准研究及IDE接口的FPGA实现。
2024-03-15 12:10:01
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此外，由于FPGA通过软件方式实现整个信息采集系统的接口和时序控制的功能，所以本文第四章专门讨论了使用VHDL语言在FPGA内实现的数据采集、数据通讯、格式转换以及时序控制等功能，并在ISE7.1开发环境下对所设计的软件进行了
2024-03-16 21:50:01
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整个系统采用分模块的方式来实现，利用VHDL语言对各个模块进行编程，在Quartus‖中进行仿真，最后将程序下载到FPGA芯片中运行、调试。
2024-04-06 00:40:01
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然后，按照层次化、模块化的设计思想，在Xinlinx公司的ISE 7．1工具中，采用硬件描述语言VHDL作为设计输入，对各运算器和控制模块进行电路设计；采用Menter公司的ModelSim SE 6.2b
2024-04-06 01:00:02
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(677)
9.18 Flash编程器的FPGA实现(678)
9.19 在PLD开发中提高VHDL的综合质量(678)
9.20 使用VHDL进行EDA电路设计(678
2013-11-06 23:32:02
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论文中采用遗传算法自适应的确定非线性变换函数的参数对图像进行增强，在采用FPGA来实现的过程中先对系统进行模块划分，主要分为初始化模块、选择模块、适应度模块、控制模块等，然后利用VHDL语言描述各个功能模块
2013-06-03 04:50:01
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在Xilinx ISE8.2i环境下，用VHDL硬件描述语言编写程序，实现(2，1，7)卷积码的Viterbi译码器。
2013-06-24 03:10:01
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智能控制器的设计原理和设计算法进行了深入的研究与分析；其次，利用MATLAB设计单神经元PID智能控制器，针对特定的被控对象，对其进行仿真实验，获得比较理想的系统输出；然后，研究基于FPGA的单神经元智能控制算法的实现，对控制器进行VHDL
2013-04-24 16:38:21
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