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(megafunctions) 以前有个帖子说把 quartus 安装目录下的 sim 文件夹里面的文件编译进 modelsi m 里面就可以了，可是 sim 文件夹里面我要的那个函数不是.v 文件啊，
2023-10-15 22:10:01
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根据全同步数字频率计的测频原理方框图，采用VHDL语言，成功的编写出了设计程序，并在MAX+PLUS Ⅱ软件环境中，对编写的VHDL程序进行了仿真，得到了很好的效果。
2013-06-05 18:20:01
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本文首先概述音频管理组件、自动测试系统及其在民航领域的应用，并阐述了课题的背景、研究目标和相关技术要求；文章对可编程逻辑器件CPLD/FPGA的结构原理、硬件描述语言VHDL的特点以及MAXL+plusⅡ
2013-08-06 08:30:02
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根据全同步数字频率计的测频原理方框图，采用VHDL语言，成功的编写出了设计程序，并在MAX+PLUS Ⅱ软件环境中，对编写的VHDL程序进行了仿真，得到了很好的效果。
2013-04-24 16:38:37
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.21ic.com/download/modelsim-266342.html
ModelSim是优秀的HDL仿真软件之一，它能提供友好的仿真环境，是业界唯一单内核支持VHDL
2022-09-16 10:50:02
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通过图形化、文本或两者的组合，结合IP的引入，快速高效的创建设计，HDL可视化和统一的HDL风格和文档能力，版本管理为团队设计提供了基础，全面的VHDL、Verilog和mixed-HDL支持适应百万门的
2023-04-16 19:00:02
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本文整个设计从总体结构到局部功能的实现是基于现代EDA技术，在FPGA上使用VHDL硬件描述语言，采用自顶向下的设计方法和模块化设计思想设计出了采用RISC五级流水线处理器。
2023-06-08 03:20:09
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根据全同步数字频率计的测频原理方框图，采用VHDL语言，成功的编写出了设计程序，并在MAX+PLUS Ⅱ软件环境中，对编写的VHDL程序进行了仿真，得到了很好的效果。
2023-06-11 02:30:17
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文章分析研究了传统误码仪的工作原理与结构，制定出以FPGA为核心的误码仪设计方案，提出采用FPGA来完成误码仪的控制和测试模块一体化设计，利用VHDL语言在FPGA芯片上模拟实现了绝大部分的传统误码仪的功能
2023-06-27 06:20:03
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根据全同步数字频率计的测频原理方框图，采用VHDL语言，成功的编写出了设计程序，并在MAX+PLUS Ⅱ软件环境中，对编写的VHDL程序进行了仿真，得到了很好的效果。
2023-10-02 18:00:01
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本文首先概述音频管理组件、自动测试系统及其在民航领域的应用，并阐述了课题的背景、研究目标和相关技术要求；文章对可编程逻辑器件CPLD/FPGA的结构原理、硬件描述语言VHDL的特点以及MAXL+plusⅡ
2023-10-07 00:20:01
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本文首先概述音频管理组件、自动测试系统及其在民航领域的应用，并阐述了课题的背景、研究目标和相关技术要求；文章对可编程逻辑器件CPLD/FPGA的结构原理、硬件描述语言VHDL的特点以及MAXL+plusⅡ
2023-12-29 11:20:01
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文中给出的虽然是专用于谱仪控制系统中信号处理器的设计的实现过程,但整体的设计思想和设计方法却具有通用性.设计从指令的功能入手,采用部分译码的方法来实现各条指令所发出的控制信号.整个设计采用自顶向下的设计方法,用VHDL
2024-01-25 21:50:01
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最后以FPGA芯片XCS200为硬件平台，以ISE6为软件平台，利用VHDL语言描述的方式实现了512点16Bit复数的快速傅立叶变换系统，并进行了仿真、综合等工作。
2013-06-08 19:50:01
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本文详细的介绍了本次设计的具体实现过程和方法，将现场可编程逻辑器件（FPGA）和 DDS技术相结合，具体的体现了基于VHDL语言的灵活设计和修改方式是对传统频率合成实现方法的一次重要改进。
2013-04-24 16:38:34
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高性能数字调制器的FPGA实现方案；采用自顶向下的设计思想，将系统分成串/并变换器、差分编码器、数控振荡器、移相器、乘法电路和加法电路等6大模块，重点论述了串/并变换、差分编码、数控振荡器的实现，用原理图输入、VHDL
2013-11-23 06:40:01
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整个设计完全采用硬件逻辑VHDL语言，集成在一枚Altera的cyclone芯片内，设计了单片机总线与FPGA接口逻辑，数据缓存的双端口RAM、FIFO和UART串行发送模块。
2013-10-11 10:20:02
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订单的管理
·vhdl,用i2c控制philips的7111和7
·基于winsock2的网络封包截获技术,源代码清楚
2015-10-27 00:28:01
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段数码是纯组合电路，通常的小规模专用IC，如74或4000系列的器件只能作十进制BCD码译码，然而数字系统中的数据处理和运算都是2进制的，所以输出表达都是16进制的，为了满足16进制数的译码显示，最方便的方法就是利用VHDL
2014-01-08 04:51:10
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实现了一种基于FPGA的信道编译码方法，并给出了VHDL语言的实现方法及仿真波形。信道编译码系统包括发射端的信道编码和接收端的信道译码两大部分。
2013-12-25 15:20:09
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