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根据预定的设计要求和设计思路，使用VHDL硬件描述
语言设计了一一个实际的基于Ahera FPGA芯片的出租车计价系统，介绍了该系统的电路结构和程序设计。
2023-06-07 07:50:02
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本文设计了一套卫星图像模拟源系统，以模拟多路ccD 相机数据．系统基于FPGA 和LAN91C111搭建，可以在联网和自动两种工作模式下工作．为了满足17路图像数据同时发送的要求，采用了MicroBlaze和VHDL
2024-09-06 10:10:01
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8阶2FSK信号去噪自适应滤波器的模型，结合多种EDA工具，在EPFlOKl00EQC208-1器件上设计出了最高数据处理速度为36.63MHz的8阶LMS自适应滤波器，其速度是文献[3]通过编写底层VHDL
2013-06-01 18:30:01
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整个电路系统在FPGA 内部用VHDL语言编程配置实现，无需额外增加系统的成本和体积。
2023-09-30 12:40:02
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该设计采用了Altera公司Cyclone系列的EP1C3T144C8 FPGA,在Quartus Ⅱ集成环境下用VHDL硬件描述语言实现。
2023-10-01 19:20:01
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8阶2FSK信号去噪自适应滤波器的模型，结合多种EDA工具，在EPFlOKl00EQC208-1器件上设计出了最高数据处理速度为36.63MHz的8阶LMS自适应滤波器，其速度是文献[3]通过编写底层VHDL
2023-10-31 11:20:01
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设计过程中，利用了VHDL语言的结构严谨、表达清晰的特点，用高层次的描述语言直接去构造最底层的硬件逻辑结构；又充分利用模块化的设计，发挥了可重用技术的优点，使设计层次分明、硬件结构简洁明了。
2024-01-23 14:40:02
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该设计采用了Altera公司Cyclone系列的EP1C3T144C8 FPGA,在Quartus Ⅱ集成环境下用VHDL硬件描述语言实现。
2024-03-03 03:40:02
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整个系统采用分模块的方式来实现，利用VHDL语言对各个模块进行编程，在Quartus‖中进行仿真，最后将程序下载到FPGA芯片中运行、调试。
2024-04-06 00:40:01
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设计选用硬件描述语言VerilogHDL，在QuartusⅡ中完成模块的综合和布局布线，在QuartusⅡ和Modelsim中进行时序仿真验证，最终下载到自主设计Altera公司的Cyclone开发板中
2013-06-14 16:00:01
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设计选用硬件描述语言VerilogHDL，在QuartusⅡ中完成模块的综合和布局布线，在QuartusⅡ和Modelsim中进行时序仿真验证，最终下载到自主设计Altera公司的Cyclone开发板中
2023-09-27 22:00:02
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环境下对系统里的每个子模块完成了功能仿真，并取得满意的仿真结果；其次，在QDPSK调制解调系统功能仿真正确的基础上，对每个模块的功能编写C++算法，并且验证了算法的正确性和可实现性；最后，在altera公司的FPGA开发平台Quartus
2013-04-24 16:38:22
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环境下对系统里的每个子模块完成了功能仿真，并取得满意的仿真结果；其次，在QDPSK调制解调系统功能仿真正确的基础上，对每个模块的功能编写C++算法，并且验证了算法的正确性和可实现性；最后，在altera公司的FPGA开发平台Quartus
2013-07-21 10:20:01
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最后，在Quartus Ⅱ 6.0平台上，完成模拟器中脉冲压缩等信号处理部分基于Verilog HDL 语言的软件设计及功能、时序仿真，并完成了相关硬件的设计。
2013-07-13 12:10:01
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本文设计的扩频通信系统主要包括串并/并串转换、差分编/解码、DDS、扩频/解扩、QPSK调制/解调等模块，基于Altera公司的Quartus Ⅱ 4.1开发平台对以上各模块进行了设计和时序仿真.仿真结果证明
2013-06-19 04:00:01
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本书附带光盘中收录了altera quartus ii web版软件，读者可以安装使用，同时还收录了本书所有实例的完整工程、源代码和使用说明文件，便于读者边学边练，
2022-06-13 23:00:02
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大体来说有两类：一是，step by step的指导如何操作Quartus软件，这类方法的优点是上手快，但却有知其然不知其所以然之惑；二是，从一个很高的起点分析一些具体问题，优点是有深度，但也把大部分初学者拒之门外
2022-07-27 16:00:02
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本文设计的扩频通信系统主要包括串并/并串转换、差分编/解码、DDS、扩频/解扩、QPSK调制/解调等模块，基于Altera公司的Quartus Ⅱ 4.1开发平台对以上各模块进行了设计和时序仿真.仿真结果证明
2023-06-10 00:50:06
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环境下对系统里的每个子模块完成了功能仿真，并取得满意的仿真结果；其次，在QDPSK调制解调系统功能仿真正确的基础上，对每个模块的功能编写C++算法，并且验证了算法的正确性和可实现性；最后，在altera公司的FPGA开发平台Quartus
2023-10-03 10:10:01
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最后，在Quartus Ⅱ 6.0平台上，完成模拟器中脉冲压缩等信号处理部分基于Verilog HDL 语言的软件设计及功能、时序仿真，并完成了相关硬件的设计。
2023-10-03 15:30:01
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