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Protel 99SE容易使用的特性还体现在“这是什么”帮助，按下右上角的小问号，然后输入你所要的信息，可以很快地看到特性的功能，然后用到设计中，按下状态栏末端的按钮，使用自然语言帮助顾问。
2023-02-23 21:40:03
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Protel 99SE容易使用的特性还体现在“这是什么”帮助，按下右上角的小问号，然后输入你所要的信息，可以很快地看到特性的功能，然后用到设计中，按下状态栏末端的按钮，使用自然语言帮助顾问。
2014-03-30 12:22:14
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Protel 99SE容易使用的特性还体现在“这是什么”帮助，按下右上角的小问号，然后输入你所要的信息，可以很快地看到特性的功能，然后用到设计中，按下状态栏末端的按钮，使用自然语言帮助顾问。
2014-03-30 12:22:14
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3．在深入研究了线性与非线性滤波几种图像处理算法，分析比较了各自的优缺点的基础上，本文提出一种适合于FPGA的快速图像中值滤波算法，并给出该算法的硬件实现结构图，应用VHDL硬件描述语言编程、实现，仿真结果表明
2013-07-13 08:30:01
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3．在深入研究了线性与非线性滤波几种图像处理算法，分析比较了各自的优缺点的基础上，本文提出一种适合于FPGA的快速图像中值滤波算法，并给出该算法的硬件实现结构图，应用VHDL硬件描述语言编程、实现，仿真结果表明
2023-10-08 01:10:01
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3．在深入研究了线性与非线性滤波几种图像处理算法，分析比较了各自的优缺点的基础上，本文提出一种适合于FPGA的快速图像中值滤波算法，并给出该算法的硬件实现结构图，应用VHDL硬件描述语言编程、实现，仿真结果表明
2024-03-08 20:10:01
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接着介绍了Viterbi译码器各个模块实现的一些经典算法，对这些算法的硬件结构设计进行优化并利用FPGA实现，而后在QuartusⅡ平台上对各模块的实现进行仿真以及在Matlab平台上对结果进行验证。
2013-07-30 20:00:01
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本文主要介绍了notepad++和sublime text3在vivado 2015.3、Quartus II 13.0 (64-bit)和Diamond 3.7(64-bit)中绑定的方法；其它文本编辑器也可用类似的方法绑定
2022-09-11 19:30:02
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本文主要采用了Altera公司生产的FPGA芯片EP1C6Q240C8和DALLAS公司生产的E1接口芯片DS26521，基于ProtelDXP软件设计语音中继接口的硬件电路，使用Altera提供的QuartusⅡ
2023-10-02 17:30:02
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为DBF在FPGA上硬件设计的正确性和可靠性提供了依据，并使用Altera公司的QuartusⅡ5．0软件完成了DBF系统的硬件设计工作。
2023-10-08 09:50:01
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接着介绍了Viterbi译码器各个模块实现的一些经典算法，对这些算法的硬件结构设计进行优化并利用FPGA实现，而后在QuartusⅡ平台上对各模块的实现进行仿真以及在Matlab平台上对结果进行验证。
2023-10-31 15:00:02
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本文主要采用了Altera公司生产的FPGA芯片EP1C6Q240C8和DALLAS公司生产的E1接口芯片DS26521，基于ProtelDXP软件设计语音中继接口的硬件电路，使用Altera提供的QuartusⅡ
2024-03-02 10:40:01
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为DBF在FPGA上硬件设计的正确性和可靠性提供了依据，并使用Altera公司的QuartusⅡ5．0软件完成了DBF系统的硬件设计工作。
2024-03-08 12:20:01
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器件设计了IP核,介绍了I P核设计中主要模块的设计方法.最后对该IP核进行了分析,给出它的性能参数.该课题系统地论述了基3-DES算法的密码IP核设计全过程.文章首先阐述了该设计的课题背景,给出了使用VHDL
2013-04-24 16:38:33
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需要处理的空间科学数据量激增,要求建立一个高速的空间数据连接网络.高速复接器作为空间飞行器星上网络的关键设备,其性能对整个空间数据网络的性能起着重要影响.该文阐述了利用先入先出存储器FIFO进行异步速率调整,应用VHDL
2013-07-17 02:50:01
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器件设计了IP核,介绍了I P核设计中主要模块的设计方法.最后对该IP核进行了分析,给出它的性能参数.该课题系统地论述了基3-DES算法的密码IP核设计全过程.文章首先阐述了该设计的课题背景,给出了使用VHDL
2024-01-13 02:00:01
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需要处理的空间科学数据量激增,要求建立一个高速的空间数据连接网络.高速复接器作为空间飞行器星上网络的关键设备,其性能对整个空间数据网络的性能起着重要影响.该文阐述了利用先入先出存储器FIFO进行异步速率调整,应用VHDL
2024-01-19 10:40:01
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该系统自带控制器，采用“微处理器+存储器+可编程逻辑器件“的模式进行设计，器件的功能均可用编程的方法实现；在软件编程方面，采用硬件描述语言(VHDL)实现可编程逻辑器件逻辑控制功能，设计采用自顶向下的设计方法
2025-02-02 15:50:01
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CPLD芯片的设计主要在MAX+plusⅡ10.0环境下利用VHDL语言编程实现。驱动步进电机电路主要利用ULN2803作为驱动芯片。
2013-08-30 13:30:17
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采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。
2013-10-17 19:32:01
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