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如图1所示，我们采用上述分割方法，而且信号线跨越了两个地之间的间隙，信号电流的返回路径是什么呢？
2013-10-23 18:28:01
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如图1所示，我们采用上述分割方法，而且信号线跨越了两个地之间的间隙，信号电流的返回路径是什么呢？
2013-10-19 12:56:01
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C语言中，修饰符volatile含义是什么？其应用场合有哪些？
2022-08-29 03:30:02
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多年的实践已经证明了，你需要清楚地了解到有关制造加工方面的需求是什么，有什么方面的限制，在PCB设计阶段或之后的处理过程是什么。
2013-11-23 06:16:01
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多年的实践已经证明了，你需要清楚地了解到有关制造加工方面的需求是什么，有什么方面的限制，在PCB设计阶段或之后的处理过程是什么。
2013-11-07 15:08:01
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本SATA2．0硬盘加解密接口电路在Xilinx公司的Virtex5 XC5VLX50T FPGA上进行测试，目前工作正常，性能良好，已经达到项目性能指标要求。
2013-04-24 16:38:21
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分别对这些模块进行了综合和时序仿真，并将验证后通过的系统模块下载到Xilinx virtex-Ⅱ Pro的FPGA中，进行了在线测试，验证了该系统对输入的残差数据实时压缩编码的功能。
2013-06-13 08:00:02
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分别对这些模块进行了综合和时序仿真，并将验证后通过的系统模块下载到Xilinx virtex-Ⅱ Pro的FPGA中，进行了在线测试，验证了该系统对输入的残差数据实时压缩编码的功能。
2013-05-25 19:00:02
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就是缓解高处理数据率和低传输数据率的矛盾,使得在不太影响成像质量的前提下,尽量减少传输的数据率,有利于后续处理的硬件实现,做到实时处理.论文结合电子所合成孔径雷达实时成像处理系统,设计开发了基于Xilinx Virtex-E
2013-07-03 17:10:01
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本文基于xil inx公司提供的开发环境(ise8.2)、和Virtex2P系列XC2VP30的开发版来设计的，提出一种基于方波的利用DCM(数字时钟管理器)检相的相位式测距方法；采用三把侧尺频率分别是
2013-06-12 04:30:01
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本文基于Xilinx公司的Virtex5系列FPGA平台，使用VerilogHDL语言实现了伪随机数发生模块、随机数接口模块、存储器接口/控制模块和系统控制模块等系统功能模块，以及基本位交叉算子模块、PMX
2013-06-15 18:40:02
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通过FMC连接器与Xilinx公司的Virtex-6FPGAML605开发板相连，实现射频应用开发，在宽带通信、测试等场合均能有良好的表现，对现阶段的软件无线电研究以及产品开发有着用药的价值和意义。
2022-07-11 11:20:02
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本文基于xil inx公司提供的开发环境(ise8.2)、和Virtex2P系列XC2VP30的开发版来设计的，提出一种基于方波的利用DCM(数字时钟管理器)检相的相位式测距方法；采用三把侧尺频率分别是
2023-06-12 16:40:04
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本SATA2．0硬盘加解密接口电路在Xilinx公司的Virtex5 XC5VLX50T FPGA上进行测试，目前工作正常，性能良好，已经达到项目性能指标要求。
2023-09-27 12:10:01
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加密桥控制器IP在Xilinx公司的Virtex-5 TM FPGA上工作正常，性能良好，已达到设计的性能指标。本文对于SATA2.0加密桥控制器的研究具有一定的工程设计参考价值。
2023-09-28 06:50:01
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本文利用SRAM技术的在系统可编程特性，结合数字电路前端设计方法，实现了一种既能够满足作Virtex-E系列FPGA基本逻辑单元应用又可动态配置的CLB电路结构。
2023-09-28 08:10:01
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本文基于xil inx公司提供的开发环境(ise8.2)、和Virtex2P系列XC2VP30的开发版来设计的，提出一种基于方波的利用DCM(数字时钟管理器)检相的相位式测距方法；采用三把侧尺频率分别是
2023-10-01 17:40:01
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分别对这些模块进行了综合和时序仿真，并将验证后通过的系统模块下载到Xilinx virtex-Ⅱ Pro的FPGA中，进行了在线测试，验证了该系统对输入的残差数据实时压缩编码的功能。
2023-10-04 09:50:01
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分别对这些模块进行了综合和时序仿真，并将验证后通过的系统模块下载到Xilinx virtex-Ⅱ Pro的FPGA中，进行了在线测试，验证了该系统对输入的残差数据实时压缩编码的功能。
2024-01-05 14:00:02
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就是缓解高处理数据率和低传输数据率的矛盾,使得在不太影响成像质量的前提下,尽量减少传输的数据率,有利于后续处理的硬件实现,做到实时处理.论文结合电子所合成孔径雷达实时成像处理系统,设计开发了基于Xilinx Virtex-E
2024-01-25 22:30:01
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