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12. ISE最常用的FPGA、CPLD开发软件教程.
13. 一个使用AT89C2051单片机作为主控芯片的全自动洗衣机.
14. i2c协议介绍.
15.
2015-04-24 09:51:00
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给出系统的整体框架设计和各模块的实现，包括芯片的选择、各模块之间的时序以及控制、每个运算模块详细的工作原理和算法设计流程； (2)通过VHDL语言编程来实现浮点数的加减、乘除和开方等基本运算功能； (3)在Xilinx ISE
2013-04-24 16:38:21
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@@ 本设计在研究CCSDS标准及帧同步算法的基础上，利用硬件描述语言及ISE9．2i开发平台在基于FPGA的硬件平台上设计并实现了单路数据输入及两路合路数据输入的帧同步算法，并解决了其中可能存在的帧滑动及模糊度问题
2013-06-11 19:10:01
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在Modelsim6.0仿真软件环境中进行仿真，在Xilinx公司的ISE9.li开发平台上进行了下载，搭建外围电路，用Agilem逻辑分析仪进行数据采集，分析测试结果。
2013-06-27 02:50:01
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在Modelsim6.0仿真软件环境中进行仿真，在Xilinx公司的ISE9.li开发平台上进行了下载，搭建外围电路，用Agilem逻辑分析仪进行数据采集，分析测试结果。
2013-06-08 15:20:01
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最后以FPGA芯片XC2S200为硬件平台，以ISE6.0为软件平台，利用VHDL语言描述的方式实现了512点16Bit的快速傅立叶变换系统，并进行了仿真、综合等工作。
2013-06-02 19:10:01
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利用ISE9.2i和Modelsim6.Oc软件平台对程序进行设计、综合和仿真，并将仿真结果和MATLAB软件计算结果相对比。结果表明，采用16位数据总线可达到理想的精度。
2013-04-24 16:38:41
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描述了FPGA开发的流程，并结合流程介绍了集成开发环境ISE和仿真软件ModelSim。
2023-06-09 22:41:02
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在Modelsim6.0仿真软件环境中进行仿真，在Xilinx公司的ISE9.li开发平台上进行了下载，搭建外围电路，用Agilem逻辑分析仪进行数据采集，分析测试结果。
2023-06-13 07:10:16
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根据FPGA的外围器件A/D模数转换器和DSP以及要实现的相关检测算法，本课题对FPGA内部的功能进行了模块划分，以Xilinx ISE为软件平台，采用Verilog HDL语言对其进行编程实现，主要设计的功能模块有
2023-06-27 13:20:03
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控制器模块与分数阶控制系统的仿真平台；用经典的时域方法（改进的主导极点法）及频域方法（幅值、相位裕量法）进行了分数阶PrD控制器设计，并通过仿真对这两种方法的鲁棒性进行了对比研究；采用优化方法设计了基于ITAE准则和ISE
2023-09-08 12:00:02
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整个设计使用Verilog HDL，硬件开发语言，在ISE 10.0仿真软件环境下开发，采用Xilinx Virtex-II Pro FPGA.硬件平台上进行了实现，并给出了该系统与PC机的性能比较。
2023-09-26 02:10:01
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给出系统的整体框架设计和各模块的实现，包括芯片的选择、各模块之间的时序以及控制、每个运算模块详细的工作原理和算法设计流程； (2)通过VHDL语言编程来实现浮点数的加减、乘除和开方等基本运算功能； (3)在Xilinx ISE
2023-09-26 07:10:01
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然后基于ISE开发平台和verligoHDL硬件描述语言，对MIMO-OFDM基带系统的QPSK调制解调、D-BLAST空时编译码、OFDM调制解调和MIMO检测进行了FPGA设计，完成了各功能模块的编程实现
2023-09-26 10:30:01
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@@ 本设计在研究CCSDS标准及帧同步算法的基础上，利用硬件描述语言及ISE9．2i开发平台在基于FPGA的硬件平台上设计并实现了单路数据输入及两路合路数据输入的帧同步算法，并解决了其中可能存在的帧滑动及模糊度问题
2023-09-27 13:10:01
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通过对FPGA实现过程的学习，重点介绍了FPGA中IP core的使用，随后在Xilinx ISE集成开发环境下，基于XILINX公司的Virtex-4系列芯片，完成了FIR成形滤波器和复调制/解调的FPGA
2023-09-28 10:00:01
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在Modelsim6.0仿真软件环境中进行仿真，在Xilinx公司的ISE9.li开发平台上进行了下载，搭建外围电路，用Agilem逻辑分析仪进行数据采集，分析测试结果。
2023-10-01 11:00:02
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描述了FPGA开发的流程，并结合流程介绍了集成开发环境ISE和仿真软件ModelSim。
2023-10-02 22:00:01
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最后以FPGA芯片XC2S200为硬件平台，以ISE6.0为软件平台，利用VHDL语言描述的方式实现了512点16Bit的快速傅立叶变换系统，并进行了仿真、综合等工作。
2023-10-05 11:10:01
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在完成了系统前端的硬件设计后，本文对FPGA的整体逻辑功能进行模块划分，并对其中的各个功能模块进行软件设计，同时，在ISE开发平台下，利用VHDL硬件描述语言来实现各模块的功能。
2023-10-08 21:40:01
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