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具体内容包括：eda开发概述、altera quartus ii开发流程、altera quartus ii开发向导、vhdl语言、基本逻辑电路设计、宏模块、lpm函数应用、基于fpga的dsp开发设计
2013-10-29 15:56:01
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具体内容包括：eda开发概述、altera quartus ii开发流程、altera quartus ii开发向导、vhdl语言、基本逻辑电路设计、宏模块、lpm函数应用、基于fpga的dsp开发设计
2015-01-01 20:09:01
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最后，利用VHDL语言在复杂可编 程逻辑器件(CPLD)上完成了LDPC码编码器的硬件实现。
2022-09-20 23:30:02
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在Xilinx ISE6.3i软件集成环境下，通过对Xilinx提供的IP核的调用，并与VHDL语言相结合，完成雷达信号处理的FPGA实现。
2023-06-09 22:30:03
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信号处理单元的设计以Xilinx ISE为软件平台，采用VHDL和IP核的方法，设计了时钟产生模块、数据滑动模块、FFT运算模块、求模运算模块、信号控制模块，完成信号处理单元的设计，并采用ModelSim
2023-06-10 12:00:14
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本文首先介绍了矩阵运算的特点和原理，接着讨论了FPGA浮点运算单元的VHDL设计方法，在此基础上，设计了矩阵相乘累加、三角矩阵求逆和一般矩阵分解求逆的运算模块，给出矩阵阶数扩大时各种矩阵运算的分块实现方法
2023-06-11 07:51:10
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在Xilinx ISE6.3i软件集成环境下，通过对Xilinx提供的IP核的调用，并与VHDL语言相结合，完成雷达信号处理的FPGA实现。
2023-06-26 23:20:04
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整个设计采用VHDL(超高速硬件描述语言)语言作为系统内部硬件结构的描述手段，在Altera的QuartusⅡ软件支持下完成。
2023-09-23 23:00:02
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信号处理单元的设计以Xilinx ISE为软件平台，采用VHDL和IP核的方法，设计了时钟产生模块、数据滑动模块、FFT运算模块、求模运算模块、信号控制模块，完成信号处理单元的设计，并采用ModelSim
2023-10-03 08:20:02
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本文首先介绍了矩阵运算的特点和原理，接着讨论了FPGA浮点运算单元的VHDL设计方法，在此基础上，设计了矩阵相乘累加、三角矩阵求逆和一般矩阵分解求逆的运算模块，给出矩阵阶数扩大时各种矩阵运算的分块实现方法
2023-10-03 15:10:01
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本文的主要工作有：1)采用现场可编程门阵列(FPGA)实现了 RS 码的编码和译码；2)采用更高效的RiBM算法，不仅减少了逻辑单元(Logic Element)的使用量，而且速度上也得到提高；3)用 VHDL
2023-10-03 21:50:01
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软件部分，应用Quartus Ⅱ和硬件描述语言VHDL在FPGA中完成了基带数字信号处理模块(串并转换模块、差分编码模块)和与AD9857的通信模块(串口通信模块、并口通信模块)的设计，并进行了仿真，仿真结果达到了设计要求
2023-10-09 06:30:02
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本文是对基于FPGA的全数字QPSK通信系统进行了研究，首先讨论了QPSK通信系统的基本原理，并用Matlab仿真系统的误码率，其次，采用VHDL在XILINX公司ISE6.1开发环境下对系统的FPGA
2023-10-12 04:20:01
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整个设计采用VHDL(超高速硬件描述语言)语言作为系统内部硬件结构的描述手段，在Altera的QuartusⅡ软件支持下完成。
2023-11-01 08:40:02
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译码延迟比传统方法小(L-1)倍,仿真结果也证明了其正确性.本维特比译码器的硬件采用了先进的现场可编程门阵列(FPGA),文中首先对本设计使用的FPGA器件及开发工具MAX+PLUSIIT 和所使用的编程语言VHDL
2024-01-11 06:20:01
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文章对方案的设计思想、原理与实现方法进行了详细的阐述；对系统的硬件电路设计与调试进行了详细的阐述；对使用硬件描述语言VHDL对FPGA芯片的开发进行了详细的阐述。
2024-01-14 16:40:01
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整个设计采用VHDL(超高速硬件描述语言)语言作为系统内部硬件结构的描述手段，在Altera的QuartusⅡ软件支持下完成。
2024-01-17 15:00:02
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本文的主要工作有：1)采用现场可编程门阵列(FPGA)实现了 RS 码的编码和译码；2)采用更高效的RiBM算法，不仅减少了逻辑单元(Logic Element)的使用量，而且速度上也得到提高；3)用 VHDL
2024-01-18 13:10:01
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整个系统由VHDL语言编写程序，采用Xilinx公司的SpartanⅡ系列FPGA芯片完成硬件实现。为电力线调制解调器芯片的实现打下了基础。
2024-01-22 13:20:02
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软件部分，应用Quartus Ⅱ和硬件描述语言VHDL在FPGA中完成了基带数字信号处理模块(串并转换模块、差分编码模块)和与AD9857的通信模块(串口通信模块、并口通信模块)的设计，并进行了仿真，仿真结果达到了设计要求
2024-02-19 18:20:01
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