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FPGA内设计同步FIFO和异步FIFO
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嵌入式系统开发学习如何起步、如何深入 很多新手学习嵌入式系统
嵌入式系统开发学习如何起步、如何深入 很多新手学习嵌入式系统，不清楚那么多方向舵知识和参考书，该从哪里开始学习。入手了，却又在该先学习什么后学习什么上失
去方向。
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FIFO设计的参考文档 Project name : Fifo -- Project description : Fifo controller Unit 工程名 : FIF
FIFO设计的参考文档
Project name : Fifo
-- Project description : Fifo controller Unit
工程名 : FIFO.VHD
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FIFO电路(first in
FIFO电路(first in，first out)，内部藏有１６ｂｉｔ×１６ｗｏｒｄ的Dual port RAM，依次读出已经写入的数据。因为不存在Address输入，所以请自行设计内藏的读写指针。
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异步FIFO结构
设计一个FIFO是ASIC设计者遇到的最普遍的问题之一。本文着重介绍怎样设计FIFO——这是一个看似简单却很复杂的任务。
一开始，要注意，FIFO通常用于时钟域的过渡，是双时钟设计。换句话说，设
一开始，要注意，FIFO通常用于时钟域的过渡，是双时钟设计。换句话说，设
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FPGA_FIFO
基于FPGA的非对称同步FIFO设计
基于FPGA的非对称同步FIFO设计-FPGA-based design of non-symmetric synchronous FIFO