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本项目完成了DVB-H传输系统信道编码的FPGA硬件设计和实现，系统所有FPGA硬件电路设计采用了Veillog HDL语言编写。
2023-12-29 09:40:01
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运用HDL语言程序实现了本文提出的电路结构，在EDA工具中进行了综合，生成了RTL级电路，并且进行了综合后仿真。仿真结果表明设计完全正确，并且得到了很好的性能。
2024-03-04 18:10:01
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对该系统在不同信噪比情况下的错误概率进行了计算，并绘出了信噪比-错误概率曲线；其次，利用DSPBuilder中的Signalcompiler将Chen-Mobius多路通信系统的主体模块(函数及积分器的产生等)转化成HDL
2024-05-06 12:20:01
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而且只需将HDL代码多次复制，就可实现多个被测ADC在同一时刻并行地被评估，配置灵活。基于FPGA的ADC并行测试方法易于实现，具有可行性，但由于噪声的影响，测试精度有待进一步提高。
2024-05-28 03:30:01
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本文详细分析了三种伪码同步跟踪方法的特点，并利用matlab和verilog程序进行了系统性的仿真。
2023-09-27 10:20:02
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XilinxISE环境下采用硬件描述语言设计输入方法与原理图设计输入方法相结合的混合设计输入方法进行FPGA/CPLD的电路设计与输入，建立相同功能的SVPWM系统模型，然后利用ISESimulator（VHDL/Verilog
2013-06-27 11:30:02
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XilinxISE环境下采用硬件描述语言设计输入方法与原理图设计输入方法相结合的混合设计输入方法进行FPGA/CPLD的电路设计与输入，建立相同功能的SVPWM系统模型，然后利用ISESimulator（VHDL/Verilog
2013-07-30 09:10:01
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其次,论文说明了FIR数字滤波器模块的划分,并用Verilog语言在Modelsim环境下进行了功能测试。
2013-05-24 13:50:01
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最后，用Verilog硬件描述语言对所设计的CAVLC编码器进行了描述，用EDA软件对其主要功能模块进行了仿真，并在Cyclone II系列EP2C20F484的FPGA上验证了它们的功能。
2013-06-22 21:30:02
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第二章介绍了PLD的分类、工艺和结构特点，以及FPGA的开发环境、开发流程和Verilog语言的特点。第三章对OFDM系统的同步模块进行详细的阐述。
2013-04-24 16:38:25
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最后，用Verilog硬件描述语言对所设计的CAVLC编码器进行了描述，用EDA软件对其主要功能模块进行了仿真，并在Cyclone II系列EP2C20F484的FPGA上验证了它们的功能。
2013-06-04 15:30:02
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在FPGA测试中,可以证明用Verilog实现后AGC也同样能较好的工作。 本文实现的基于导频的步进式的数字AGC是针对WiMAX系统的自动增益控制电路提出的解决方案。
2013-04-24 16:38:35
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最后，用Verilog语言对所设计的CABAC解码器进行了描述，用EDA软件对其进行了仿真，并在FPGA上验证了其功能，结果显示，该CABAC解码器结构显著提高了解码效率，能够满足高档次实时通讯的要求。
2013-07-03 11:30:01
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2．在FPGA设计中，编写Verilog程序，完成了虹膜图像采集模块、乒乓存储器切换模块、图像采样模块以及将采样后的图像显示在TFT彩色液晶上的模块，最终实现了虹膜图像实时显示系统。
2013-04-24 16:38:35
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设计中跳频图案、直接数字频率合成器、频率识别、位同步、跳频图案恢复、线性调频z变换等模块均采用Verilog和VHDL两种通用硬件描述语言进行设计，以便能够在所有厂家的FPGA芯片中移植。
2013-07-22 23:50:01
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其次,论文说明了FIR数字滤波器模块的划分,并用Verilog语言在Modelsim环境下进行了功能测试。
2013-07-15 07:30:01
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其次，用Verilog语言设计了基于FPGA的指纹识别算法的硬件电路。
2013-07-28 05:50:01
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此外，本文也简单介绍了DSP应用系统设计中的几个关键问题以及如何在线Bootloader，并给出了本文的部分设计原理图和部分Verilog源代码。
2013-07-02 01:50:02
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设计中采用编写Verilog程序和使用IP核相结合的办法，实现了新的联合同步算法，并且通过简化结构，避免了信道估计算法中的繁琐除法。
2013-04-24 16:38:41
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2、选择第二项Add or Create Design Sources，用来添加或新建Verilog或VHDL源文件，点击Next
2022-05-28 21:00:01
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