找到约 5,063 条结果
www.eeworm.com
然后，基于Verilog HDL 设计出12位固点数据的Turbo编译码器以及仿真验证平台，与用Matlab语言设计的相同指标的浮点数据译码器进行性能比较，得到该设计的功能验证。
2023-10-07 03:10:01
下载 2
查看 1,305
www.eeworm.com
通过分析定点仿真结果，给出了该OFDM系统的设计参数，并详细介绍了系统中部分模块(主要包括IFFT/FFT模块、数字上变频模块和同步模块)的FPGA实现结构(用Verilog硬件描述语言设计)，并对这些模块进行了功能验证
2023-10-09 12:40:01
下载 9
查看 6,497
www.eeworm.com
在对硬件描述语言以及FPGA设计流程深入理解的基础上，利用Verilog语言实现了双环PI控制器和PWM发生电路的数字化，使得有源电力滤波器补偿精度提高，有更好的可修改性，可使用于很多不同的非线性负载。
2024-03-02 08:40:01
下载 9
查看 6,519
www.eeworm.com
然后，基于Verilog HDL 设计出12位固点数据的Turbo编译码器以及仿真验证平台，与用Matlab语言设计的相同指标的浮点数据译码器进行性能比较，得到该设计的功能验证。
2024-03-05 01:40:01
下载 8
查看 8,495
www.eeworm.com
本文使用硬件描述语言Verilog，以RedLogic的RVDK开发板作为硬件平台，在开发工具OUARTUS2 6.0和MODELSIM SE 6.1B环境中完成软核的设计与仿真验证。
2024-03-10 13:30:01
下载 8
查看 266
www.eeworm.com
在ⅡR实现方面，本文采用Verilog HDL语言编写了相应的硬件实现程序，将内置SignalTap Ⅱ逻辑分析器的ⅡR设计下载到FPGA芯片，并利用Altera公司的SignalTap Ⅱ逻辑分析仪进行了定性测试
2024-03-19 23:30:01
下载 5
查看 3,537
www.eeworm.com
并在Altera QuartusⅡ 6.0集成开发环境下，采用Verilog HDL语言和调用Altera IP Core单元加以实现。 此外，为验证方案的可行性，本课题从软、硬件两方面对其进行测试。
2024-03-30 19:00:01
下载 1
查看 1,730
www.eeworm.com
本文中的主控制器采用Verilog HDL作为硬件描述语言，系统在Quartus Ⅱ 6.0，Modelsim SE 6.0软件平台下开发，采用FPGA可编程芯片，让整个系统拥有了较大的灵活性，不仅提高了数字接口的转换速度
2024-04-02 23:20:01
下载 10
查看 119
www.eeworm.com
设计选用硬件描述语言Verilog HDL，在开发工具QuartusII 中完成软核的综合、布局布线、汇编，并最终在QuartusII 和Active-HDL 中进行时序仿真验证。
2024-04-07 01:50:01
下载 5
查看 4,421
www.eeworm.com
通过分析定点仿真结果，给出了该OFDM系统的设计参数，并详细介绍了系统中部分模块(主要包括IFFT/FFT模块、数字上变频模块和同步模块)的FPGA实现结构(用Verilog硬件描述语言设计)，并对这些模块进行了功能验证
2024-04-28 22:00:01
下载 7
查看 5,527
www.eeworm.com
利用开发工具ModelSim6.2和QuartusⅡ7.2，并结合硬件描述语言Verilog，以EP2S60F1020C3开发板为目标器件完成了DDS设计的开发、仿真、综合及在线逻辑调试与分析。
2024-07-04 03:30:02
下载 2
查看 3,788
www.eeworm.com
32. uart pci 等verilog hdl 代码.
33. HD300 Mp3播放器电路图 CPU部分.
34.
2015-04-24 09:50:59
下载 13
查看 9,185
www.eeworm.com
首先，请您大致讲一下4引脚封装具体是怎样的封装，采用这种封装的背景和目的是什么。首先，采用4引脚封装是为了改善SiCMOSFET的开关损耗。
2021-11-07 21:30:01
下载 1
查看 5,759
www.eeworm.com
1.1 与其他计算机语言相比较，MATLAB语言突出的特点是什么？
2022-08-12 20:30:02
下载 7
查看 4,159
www.eeworm.com
设计中采用的关键技术包括：基于FPGA和IP Core的Verilog HDL设计、数据采集、数据存储、数据处理以及数据波形的实时显示。
2013-06-05 06:30:01
下载 93
查看 1,127
www.eeworm.com
其二，根据得到的信道自适应迭代译码方案，借助Xilinx公司Spartan3 FPGA硬件平台，使用Verilog硬件描述语言，将用C/C++语言写成的信道自适应迭代译码算法转化成为硬件设计实现，得到硬件电路
2013-05-31 12:10:02
下载 181
查看 1,182
www.eeworm.com
整个译码器模块的设计采用Verilog语言描述，并在VirtexⅡPro系列FPGA芯片上实现。
2013-04-24 16:38:25
下载 126
查看 1,181
www.eeworm.com
其次设计了基于WinCE操作系统的图像采集、GPIO、PWM、外中断EINT-19的流接口驱动程序；同时设计了基于WinCE操作系统的图像采集及压缩、网络通信、车模速度采集的应用程序；FPGA内部逻辑电路采用Verilog
2013-04-24 16:38:27
下载 120
查看 1,148
www.eeworm.com
针对某工程应用中的具体要求，我们以FPGA为平台，采用Verilog HDL语言对改进算法进行了硬件实现。
2013-06-18 08:50:01
下载 134
查看 1,103
www.eeworm.com
本文的所有逻辑模块均采用Verilog HDL语言进行描述设计。 本文最后对系统进行了调试。经实验验证，系统达到了图像实时采集、存储的功能，能进行正确可靠的工作。
2013-07-02 18:20:01
下载 101
查看 1,153