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VHDL Test Bench created by HDL Bencher 1.02
-- Mon Feb 05 11:59:49 2001
LIBRARY ieee;
USE ieee.std_logic
2025-11-18 09:07:20
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该报告简述了QuartusⅡ仿真软件的基本操作方法，同时介绍FPGA逻辑器件的相关知识和Verilog硬件描述语言的相关知识，在基于FPGA逻辑器件、QuartusⅡ仿真软件和Verilog硬件描述语言下
2022-11-08 09:30:02
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The most dominant
HDLs today are Verilog and VHDL.
2014-01-08 21:33:01
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通信接口程序，使用VERILOG编写的FPGA所用的USB，I2C，MAC程序。
2013-06-27 18:50:02
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汉明码的编结码模块，用verilog写成，为Modelsim下的一个工程。
2015-05-20 20:15:01
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arm9 架构简单core实现，可以综合，有实现步骤和说明，verilog代码编写。
2014-12-08 06:55:02
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Quartus下的RS（5，3）编码器的源程序，用Verilog语言编写。
2014-01-26 16:29:01
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北航夏雨闻的Verilong课件，与夏雨闻写的Verilog数字系统设计教程配套
2016-02-18 00:14:01
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or1200的内核以及一些参考文献，是Verilog的RTL级描述。
2016-05-22 00:52:02
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利用FPGA实现串口通信，很好的学习资料
尤其是对 verilog不熟的朋友
2016-06-06 20:41:01
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一个完整的viterbi(2,1,7)编码程序，使用的是Verilog语言
2016-10-29 10:31:01
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usb芯片cy7c68013从fpga中读入数据的演示程序，verilog语言
2014-08-13 09:30:26
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组成原理的大作业，写一个计算器，用verilog语言写的
2016-12-26 10:10:01
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好用的UART通信源码，使用Verilog 编写 在QUARTUS下完成，并用ModelSim仿真通过
2017-01-01 20:56:01
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一位全加器，VERILOG实现，包括测试文件，测试可用，欢迎下载，共同学习
2013-12-24 09:20:01
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MIMO 4*4系统D-BLAST编译码方案，利用ISE仿真环境，verilog编程实现。
2013-12-20 16:01:01
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串并转换功能，采用VERILOG语言编写，包括测试文件，与大家分享，供大家参考
2017-05-25 10:12:02
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北航夏宇闻ppt讲稿，包括复杂数字系统设计方法，及Verilog语法讲解
2017-07-24 00:05:01
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自己写一个关于维mesh结构的noc网络，verilog，仿真结果无误。
2014-08-21 12:15:02
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基于verilog下，用modelsim进行仿真的简易电子表设计。可综合，已检测。
2023-01-09 10:00:02
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