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软件开发环境：ISE 7.1i 仿真环境：ModelSim SE 6.0 1. 闹钟设计
2017-05-04 00:19:02
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无线通信FPGA设计-附书配套FPGA源码
2013-07-29 17:00:01
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无线通信FPGA设计-附书配套FPGA源码
2023-04-14 17:00:02
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我自己设计的东西,不是什么好东西了,呵呵,是我自己做的毕业设计,导师还算满意,
2014-01-10 17:43:12
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本程序运用编译原理中语法分析的思想来判别一个数是什么类型的数
2016-07-24 00:18:02
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本设计采用VHDL语言的形式，在QuartusII的开发平台下完成，继而下载到FPGA中实现。
2013-07-30 08:20:01
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FPGA设计，很有用，建议看看，虽然内容较多
2013-08-19 03:30:01
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FPGA Verilog,双向端口的研究,比较全,由ASSIGN和ALWAYS模块组成,测试可用
2013-08-22 14:30:02
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FPGA代码，Designing_with_Quartus_II_Exercises_Ver11_v4_2.doc
2015-11-17 10:15:02
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基于ｆｐｇａ，采用ｑｕａｒｔｕｓ２的ＤＤＳ信号发生器，采用高速ＤＡＣ９０８为数模芯片，并可通过５１单片机送入调制信号进行ＦＭ调制
2015-11-22 00:32:02
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FPGA板，含AD/DA,LCD等模块。（原理图）
2015-12-09 10:05:02
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FPGA verilog，比较好的verilog源码，现提供给大家，供参考
2016-02-19 10:32:01
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FPGA设计，很有用，建议看看，虽然内容较多
2014-12-21 06:57:02
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FPGA开发，Verilog的经典教程，在嵌入式培训中的电子书籍。
2016-11-14 10:12:01
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针对FPGA，采用硬件描述语言VHDL实现光标移动
2013-12-19 11:56:01
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FPGA制作，逻辑分析仪！还可以用来制作其他的，例如数字电压表。
2013-12-20 02:33:20
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microprocessor for FPGA
2017-04-10 20:11:01
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FPGA内，通过Verilog语言，实现冒泡法数据排序。仅供参考！
2017-05-19 10:09:01
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alter FPGA，包含sdram的nios系统开发实验完整工程文件
2017-07-04 10:07:02
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FPGA入门 建模”顾名思义就是“模块建立”的省略。FPGA的逻辑资源，好比乐高的积木，要组合乐高就是需要工具，那Verilog HDL就是FPGA建模的工具。
2015-03-22 13:01:05
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