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PCI总线接口的FPGA实现及应用
本文在理解协议的基础上,对PCI总线接口的整体设计和子模块的划分以及Verilog实现进行了详细的分析和阐述,并编写测试激励程序完成功能仿真,最后通过PCB试验板进行了测试.我们设计了DMA控制器作为PCI总线接口板的应用
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Matlab/simulink在FPGA设计中的应用
文中首先分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点，
然后结合FSK 信号的产生原理，给出了如何利用DSP Builder 模块库建立FSK 信
然后结合FSK 信号的产生原理，给出了如何利用DSP Builder 模块库建立FSK 信
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基于FPGA在演化硬件中的应用
FPGA有更高的集成度更复杂的布线结构和逻辑实现,它与以往的PLD之间的差别在于PLD一般是通过修改内连电路的逻辑功能来实现编程的，而FPGA则是通过修改一根或多根内连线来编程。
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高性能FPGA的典型应用领域
目前以硬件描述语言(Verilog 或 VHDL)所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。
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FPGA设计的SDRAM控制器，有仿真代码，已通过验证
FPGA设计的SDRAM控制器，有仿真代码，已通过验证
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JAVA基础doc1、面向对象的特征有哪些方面 1.抽象： 抽象就是忽略一个主题中与当前目标无关的那些方面
JAVA基础doc1、面向对象的特征有哪些方面
1.抽象：
抽象就是忽略一个主题中与当前目标无关的那些方面，以便更充分地注意与当前目标有关的方面。
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如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调
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如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调