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本文纤细介绍了用Modelsim做后仿真时如何添加自己所需要的Altera库文件
2025-05-12 14:10:01
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你问你我是什么,我也不知道,你看看吧
2014-01-22 18:41:12
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销售是什么？让你成为一名合格的销售人才
2013-12-29 02:59:08
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一个有关于ajax的应用示例是什么 样子的
2017-04-28 20:18:01
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这份详尽的电子原理图采用Protel 99 SE格式设计，适用于电路设计与分析。无论您是初学者还是经验丰富的工程师，这份资源都将为您提供宝贵的参考价值。它涵盖了从基本组件布局到复杂信号处理的所有细节，确保您的项目能够顺利进行。立即免费下载，获取完整的电路设计方案！
2025-12-09 21:28:57
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让更多的朋友了解大型游戏的代码是什么样子的
2015-01-28 20:36:01
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这个我也太清楚是什么 反正师兄们说有用 发大家
2013-12-04 06:28:02
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VTMultiLineDemoCB6下载的都知道是什么用的，我不多说了哈
2016-01-14 20:51:01
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不是什么难的程序，小的程序。。大家一起探讨！
2014-05-24 04:00:13
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交通灯设计,不知道是什么东西,随便看看吧
2013-12-30 18:56:01
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猜数字游戏源码,根据提示猜被星号盖住的是什么数字
2013-12-22 01:19:06
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modelsim
2013-10-11 15:24:02
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IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调
2013-10-20 15:20:01
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modelsim
2013-10-28 18:40:01
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IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调
2013-11-02 16:00:01
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Xilinx的modelsim 仿真库！里面有许多库函数，对于ｖｌｏｇ或ｖｈｄｌ编程有很多好的源代码可以剪切！
2015-06-01 20:47:01
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关于MODELSIM的学习资料
希望对大家有用
2016-01-04 20:28:02
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经过modelsim仿真。
2013-12-31 20:43:01
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至今还没有弄明白为什么要用ModelSim，因为看波形Quartus II自带的工具就可以了
2013-12-04 20:46:01
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不错的Quartus II 与modelsim结合仿真简介笔记，较为适合初学者，希望对大家有帮助！
2013-12-22 00:45:07
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