📄 pld.drc
字号:
" --------------------
$ C333X 28 2
$ CY7B333X 28 2
$ P333X 28 2
! CELL CLK1 I B B B B B GND B B B I I I CLK2 I I B B B GND VCC B B B B B I
GLOBAL GLOBAL ;
! +QFB&PolarityAfterReg ;
! FB2_IO 16 3 4 5 6 7 9 10 11 18 19 20 23 24 25 26 27 ;
! CHAIN_FB 28
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! OUTPUT_CLK 2 1 15 ;
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6 0 0 23 7 0 0 22 8 0 0 21 9 0 0 20 10 0 0 19
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-24 24 -25 25 -26 26 -27 27 -28 28 ;
! PIN [ 1,15 ] WIRE && INP ;
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, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 4 ] ] ;
! PIN [ 4 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 5 ] ] ;
! PIN [ 5 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 6 ] ] ;
! PIN [ 6 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 7 ] ] ;
! PIN [ 7 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 9 ] ] ;
! PIN [ 9 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 10 ] ] ;
! PIN [ 10 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 11 ] ] ;
! PIN [ 11 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 18 ] ] ;
! PIN [ 18 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 19 ] ] ;
! PIN [ 19 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 20 ] ] ;
! PIN [ 20 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 23 ] ] ;
! PIN [ 23 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 24 ] ] ;
! PIN [ 24 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 25 ] ] ;
! PIN [ 25 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 26 ] ] ;
! PIN [ 26 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 27 ] ] ;
! PIN [ 27 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 3 ] ] ;
! NODE [ 29 ] OUT [ AR : BANK [ 1 ] ] ;
! NODE [ 30 ] OUT [ AR : BANK [ 2 ] ] ;
! FLOAT [ 0 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1,15 ] , AR : BANK [ 0 ] , OE : PT [ 1 ] ]
&& INP ;
" --------------------
$ C333 28 2
$ CY7B333 28 2
$ P333 28 2
$ C333B 28 2
$ CY7B333B 28 2
$ P333B 28 2
! CELL CLK1 I B B B B B GND B B B I I I CLK2 I I B B B GND VCC B B B B B I
GLOBAL GLOBAL ;
! FB2_IO 16 3 4 5 6 7 9 10 11 18 19 20 23 24 25 26 27 ;
! OUTPUT_FIT_ORDER 3,5,7,10,4,6,9,11,18,20,24,26,19,23,25,27 ;
! OUTPUT_CLK 2 1 15 ;
! PINOUT 56 1 0 0 28 2 0 0 27 3 0 0 26 4 0 0 25 5 0 0 24
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! LOGICPT 30 0 0 8 8 8 8 8 -1 8 8 8 0 0 0
0 0 0 8 8 8 -1 -1 8 8 8 8 8 0 1 1 ;
! PT 50 -1 1 -2 2 -3 3 -4 4 -5 5 -6 6 -7 7 -9 9 -10 10 -11 11
-12 12 -13 13 -14 14 -15 15 -16 16 -17 17 -18 18 -19 19 -20 20 -23 23
-24 24 -25 25 -26 26 -27 27 -28 28 ;
! PIN [ 1,15 ] WIRE && INP ;
! PIN [ 2,12,13,14,16,17,28 ] INP ;
! PIN [ 8,21 ] GND ;
! PIN [ 22 ] VCC ;
! PIN [ 3 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 4 ] ] ;
! PIN [ 4 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 5 ] ] ;
! PIN [ 5 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 6 ] ] ;
! PIN [ 6 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 7 ] ] ;
! PIN [ 7 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 9 ] ] ;
! PIN [ 9 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 10 ] ] ;
! PIN [ 10 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 11 ] ] ;
! PIN [ 11 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
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, CLK : PIN [ 1 ] , AR : BANK [ 1 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 18 ] ] ;
! PIN [ 18 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 19 ] ] ;
! PIN [ 19 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 20 ] ] ;
! PIN [ 20 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 23 ] ] ;
! PIN [ 23 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 24 ] ] ;
! PIN [ 24 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 25 ] ] ;
! PIN [ 25 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 26 ] ] ;
! PIN [ 26 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 27 ] ] ;
! PIN [ 27 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 15 ] , AR : BANK [ 2 ] , OE : PT [ 1 ] ]
&& INP [ IP [ PIN : SHARE 3 ] ] ;
! NODE [ 29 ] OUT [ AR : BANK [ 1 ] ] ;
! NODE [ 30 ] OUT [ AR : BANK [ 2 ] ] ;
! FLOAT [ 0 ] OUT [ COMB : PT [ 8 : PRG ] : FB [ Q : PIN ]
, D : PT [ 8 : PRG ] : FB [ Q : PIN ]
, T : PT [ 8 : PRG ] : FB [ Q : PIN ]
, CLK : PIN [ 1,15 ] , AR : BANK [ 0 ] , OE : PT [ 1 ] ]
&& INP ;
" --------------------
$ C330 28 12
$ CY7C330 28 12
$ P330 28 12
! XOR&InverterBeforePin ;
! CELL CLK1 CLK2 CLK3 I I I I GND I I I I I EN B B B B B B GND VCC
B B B B B B GLOBAL GLOBAL N N N N ;
! FB2_IO 12 15 16 17 18 19 20 23 24 25 26 27 28 ;
! OUTPUT_FIT_ORDER 15,28,27,16,17,26,25,18,19,24,23,20 ;
! OUTPUT_CLK 1 1 ;
! INPUT_CLK 2 2 3 ;
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14 0 0 15 ;
! LOGICPT 40 0 0 0 0 0 0 0 -1 0 0 0 0 0 0 9 19 11 17 13 15
-1 -1 15 13 17 11 19 9 1 1 13 17 11 19 -1 -1 -1 -1 -1 -1 ;
! PT 66 3 -3 4 -4 5 -5 6 -6 7 -7 9 -9 10 -10 11 -11 12 -12 13 -13 14 -14
-28 28 -40 40 -27 27 -26 26 -39 39 -25 25 -24 24 -38 38 -23 23
-34 34 -33 33 -20 20 -37 37 -19 19 -32 32 -31 31 -18 18 -36 36
-17 17 -16 16 -35 35 -15 15 ;
! PIN [ 1,2 ] WIRE ;
! PIN [ 3,14 ] WIRE &&
IREG [ CI : PIN [ 2,3 ] , IP [ PIN ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 4..7,9..13 ]
IREG [ CI : PIN [ 2,3 ] , IP [ PIN ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 15 ] OUT [ D : XOR [ 9 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 35 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 16 ] OUT [ D : XOR [ 19 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 35 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 17 ] OUT [ D : XOR [ 11 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 36 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 18 ] OUT [ D : XOR [ 17 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 36 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 19 ] OUT [ D : XOR [ 13 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 37 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 20 ] OUT [ D : XOR [ 15 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 37 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 23 ] OUT [ D : XOR [ 15 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 38 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 24 ] OUT [ D : XOR [ 13 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 38 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 25 ] OUT [ D : XOR [ 17 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 39 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 26 ] OUT [ D : XOR [ 11 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 39 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 27 ] OUT [ D : XOR [ 19 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
, IP [ PIN , SHARE 40 ] , SRI : BANK [ 1 ] , SPI : BANK [ 2 ] ] ;
! PIN [ 28 ] OUT [ D : XOR [ 9 : 1 : AL ] : FB [ Q ] ,
CLK : PIN [ 1 ] , SR : BANK [ 1 ] , SP : BANK [ 2 ] ,
OE : PT [ 1 ] ] && IREG [ CI : PIN [ 2,3 ]
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