📄 ps2_mouse9.fit.rpt
字号:
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
+----------------------------------------------------+--------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/Ps2-ALL/ps2_mouse9.pin.
+-------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+---------------------+
; Resource ; Usage ;
+---------------------------------------------+---------------------+
; Total logic elements ; 242 / 2,910 ( 8 % ) ;
; -- Combinational with no register ; 58 ;
; -- Register only ; 102 ;
; -- Combinational with a register ; 82 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 48 ;
; -- 3 input functions ; 15 ;
; -- 2 input functions ; 60 ;
; -- 1 input functions ; 50 ;
; -- 0 input functions ; 69 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 215 ;
; -- arithmetic mode ; 27 ;
; -- qfbk mode ; 15 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 92 ;
; -- asynchronous clear/load mode ; 99 ;
; ; ;
; Total LABs ; 29 / 291 ( 10 % ) ;
; Logic elements in carry chains ; 31 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 37 / 104 ( 36 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 0 ;
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; PLLs ; 0 / 1 ( 0 % ) ;
; Global clocks ; 0 / 8 ( 0 % ) ;
; Maximum fan-out node ; ps2_clk_r ;
; Maximum fan-out ; 84 ;
; Highest non-global fan-out signal ; ps2_clk_r ;
; Highest non-global fan-out ; 84 ;
; Total fan-out ; 846 ;
; Average fan-out ; 3.01 ;
+---------------------------------------------+---------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; LogicLock Region Resource Usage ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+-------+--------------+--------------+-------------------+------------------+-----------------+------------+
; LogicLock Region ; Origin ; Width ; Height ; Logic Cells ; LC Registers ; Memory Bits ; M4Ks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+-------+--------------+--------------+-------------------+------------------+-----------------+------------+
; Root Region ; X0_Y0 ; 28 ; 15 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+-------+--------------+--------------+-------------------+------------------+-----------------+------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLK1 ; 92 ; 3 ; 27 ; 8 ; 4 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; clk ; 93 ; 3 ; 27 ; 8 ; 3 ; 57 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; reset ; 1 ; 1 ; 0 ; 13 ; 0 ; 48 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+-------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; CODE1[0] ; 85 ; 3 ; 27 ; 7 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; CODE1[1] ; 96 ; 3 ; 27 ; 8 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; CODE1[2] ; 97 ; 3 ; 27 ; 9 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; CODE1[3] ; 98 ; 3 ; 27 ; 9 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; SPKS ; 129 ; 2 ; 12 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; enk_1 ; 35 ; 1 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[0] ; 39 ; 4 ; 4 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[1] ; 40 ; 4 ; 4 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[2] ; 41 ; 4 ; 6 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[3] ; 42 ; 4 ; 6 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[4] ; 47 ; 4 ; 8 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[5] ; 48 ; 4 ; 8 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[6] ; 49 ; 4 ; 8 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2A[7] ; 50 ; 4 ; 10 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2[0] ; 73 ; 3 ; 27 ; 1 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; ps2_data2[1] ; 74 ; 3 ; 27 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
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