📄 dianyabiao.fit.rpt
字号:
; 49 ; GND_INT ; ;
; 50 ; #TMS ; ;
; 51 ; #TRST ; ;
; 52 ; ^nSTATUS ; ;
; 53 ; jiao[1] ; LVTTL/LVCMOS ;
; 54 ; jiao[0] ; LVTTL/LVCMOS ;
; 55 ; sent[7] ; LVTTL/LVCMOS ;
; 56 ; sent[6] ; LVTTL/LVCMOS ;
; 57 ; sent[5] ; LVTTL/LVCMOS ;
; 58 ; sent[4] ; LVTTL/LVCMOS ;
; 59 ; GND_INT ; ;
; 60 ; sent[3] ; LVTTL/LVCMOS ;
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; 62 ; sent[1] ; LVTTL/LVCMOS ;
; 63 ; sent[0] ; LVTTL/LVCMOS ;
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; 152 ; VCC_INT ; ;
; 153 ; #TDI ; ;
; 154 ; ^nCE ; ;
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; 156 ; ^DATA0 ; ;
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; 201 ; VCC_INT ; ;
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; 206 ; GND* ; ;
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; 208 ; GND* ; ;
+-------+------------+--------------+
+-----------------------------------------------+
; Control Signals ;
+------+-------+---------+-------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+------+-------+---------+-------+--------------+
; clk ; 7 ; 14 ; Clock ; Non-global ;
+------+-------+---------+-------+--------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------------+----------+
; Name ; Fan-Out ;
+----------------------+----------+
; clk ; 14 ;
; \show:a[1]~13 ; 7 ;
; \show:a[0]~13 ; 7 ;
; \show:a[2]~6 ; 6 ;
; eoc ; 3 ;
; current_state.st2~15 ; 2 ;
; jiao[0]~331 ; 2 ;
; current_state.st3~14 ; 2 ;
; current_state.st5~14 ; 2 ;
; jiao[1]~332 ; 2 ;
; jiao[3]~334 ; 2 ;
; current_state.st4~11 ; 2 ;
; jiao[2]~333 ; 2 ;
; current_state.st6~15 ; 2 ;
; current_state.st1~8 ; 2 ;
; abc_in[0] ; 1 ;
; en~1 ; 1 ;
; abc_out[0]~0 ; 1 ;
; abc_out[2]~2 ; 1 ;
; abc_in[1] ; 1 ;
; current_state.st0~8 ; 1 ;
; abc_out[1]~1 ; 1 ;
; abc_in[2] ; 1 ;
+----------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 354 ;
; 1 ; 4 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
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