fir17.sim.rpt

采用VHDL语言实现17阶的数字低通滤波器的设计

; |fir17|d_out8[5]~reg0  ; |fir17|d_out8[5]~reg0    ; regout           ;
; |fir17|d_out8[5]~reg0  ; |fir17|d_out8[5]~71      ; cout             ;
; |fir17|d_out8[6]~reg0  ; |fir17|d_out8[6]~reg0    ; regout           ;
; |fir17|d_out8[6]~reg0  ; |fir17|d_out8[6]~73      ; cout0            ;
; |fir17|d_out8[6]~reg0  ; |fir17|d_out8[6]~73COUT1 ; cout1            ;
; |fir17|d_out8[7]~reg0  ; |fir17|d_out8[7]~reg0    ; regout           ;
; |fir17|d_out8[7]~reg0  ; |fir17|d_out8[7]~75      ; cout0            ;
; |fir17|d_out8[7]~reg0  ; |fir17|d_out8[7]~75COUT1 ; cout1            ;
; |fir17|d_out8[8]~reg0  ; |fir17|d_out8[8]~reg0    ; regout           ;
; |fir17|d_out8[8]~reg0  ; |fir17|d_out8[8]~77      ; cout0            ;
; |fir17|d_out8[8]~reg0  ; |fir17|d_out8[8]~77COUT1 ; cout1            ;
; |fir17|d_out8[9]~reg0  ; |fir17|d_out8[9]~reg0    ; regout           ;
; |fir17|d_out8[9]~reg0  ; |fir17|d_out8[9]~79      ; cout0            ;
; |fir17|d_out8[9]~reg0  ; |fir17|d_out8[9]~79COUT1 ; cout1            ;
; |fir17|d_out8[10]~reg0 ; |fir17|d_out8[10]~reg0   ; regout           ;
; |fir17|d_out8[10]~reg0 ; |fir17|d_out8[10]~81     ; cout             ;
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