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📄 part6.fit.rpt

📁 This codes is one of my univ projects I ve been working on for 3months. I d like to share it and mak
💻 RPT
📖 第 1 页 / 共 5 页
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; Global clocks                               ; 8 / 16 ( 50 % )                     ;
; JTAGs                                       ; 1 / 1 ( 100 % )                     ;
; ASMI blocks                                 ; 0 / 1 ( 0 % )                       ;
; CRC blocks                                  ; 0 / 1 ( 0 % )                       ;
; Average interconnect usage (total/H/V)      ; 0% / 0% / 0%                        ;
; Peak interconnect usage (total/H/V)         ; 3% / 3% / 2%                        ;
; Maximum fan-out node                        ; altera_internal_jtag~TCKUTAPclkctrl ;
; Maximum fan-out                             ; 96                                  ;
; Highest non-global fan-out signal           ; SW_A                                ;
; Highest non-global fan-out                  ; 32                                  ;
; Total fan-out                               ; 1473                                ;
; Average fan-out                             ; 2.84                                ;
+---------------------------------------------+-------------------------------------+
*  Register count does not include registers inside RAM blocks or DSP blocks.



+---------------------------------------------------------------------------------------------+
; Fitter Partition Statistics                                                                 ;
+---------------------------------------------+-----------------------+-----------------------+
; Statistic                                   ; Top                   ; sld_hub:sld_hub_inst  ;
+---------------------------------------------+-----------------------+-----------------------+
; Total logic elements                        ; 225 / 33216 ( < 1 % ) ; 102 / 33216 ( < 1 % ) ;
;     -- Combinational with no register       ; 136                   ; 39                    ;
;     -- Register only                        ; 22                    ; 8                     ;
;     -- Combinational with a register        ; 67                    ; 55                    ;
;                                             ;                       ;                       ;
; Logic element usage by number of LUT inputs ;                       ;                       ;
;     -- 4 input functions                    ; 113                   ; 38                    ;
;     -- 3 input functions                    ; 37                    ; 33                    ;
;     -- <=2 input functions                  ; 53                    ; 23                    ;
;     -- Register only                        ; 22                    ; 8                     ;
;                                             ;                       ;                       ;
; Logic elements by mode                      ;                       ;                       ;
;     -- normal mode                          ; 172                   ; 90                    ;
;     -- arithmetic mode                      ; 31                    ; 4                     ;
;                                             ;                       ;                       ;
; Total registers                             ; 89                    ; 63                    ;
;     -- Dedicated logic registers            ; 89 / 33216 ( < 1 % )  ; 63 / 33216 ( < 1 % )  ;
;     -- I/O registers                        ; 0                     ; 0                     ;
;                                             ;                       ;                       ;
; Virtual pins                                ; 0                     ; 0                     ;
; I/O pins                                    ; 37                    ; 0                     ;
; Embedded Multiplier 9-bit elements          ; 0 / 70 ( 0 % )        ; 0 / 70 ( 0 % )        ;
; Total memory bits                           ; 512                   ; 0                     ;
; Total RAM block bits                        ; 4608                  ; 0                     ;
; JTAG                                        ; 1 / 1 ( 100 % )       ; 0 / 1 ( 0 % )         ;
; M4K                                         ; 1 / 105 ( < 1 % )     ; 0 / 105 ( 0 % )       ;
; Clock control block                         ; 4 / 20 ( 20 % )       ; 4 / 20 ( 20 % )       ;
;                                             ;                       ;                       ;
; Connections                                 ;                       ;                       ;
;     -- Input Connections                    ; 93                    ; 98                    ;
;     -- Registered Input Connections         ; 42                    ; 71                    ;
;     -- Output Connections                   ; 135                   ; 56                    ;
;     -- Registered Output Connections        ; 5                     ; 44                    ;
;                                             ;                       ;                       ;
; Internal Congestion                         ;                       ;                       ;
;     -- Total Connections                    ; 1101                  ; 569                   ;
;     -- Registered Connections               ; 293                   ; 359                   ;
;                                             ;                       ;                       ;
; External Connections                        ;                       ;                       ;
;     -- Top                                  ; 74                    ; 154                   ;
;     -- sld_hub:sld_hub_inst                 ; 154                   ; 0                     ;
;                                             ;                       ;                       ;
; Partition Interface                         ;                       ;                       ;
;     -- Input Ports                          ; 19                    ; 15                    ;
;     -- Output Ports                         ; 18                    ; 33                    ;
;     -- Bidir Ports                          ; 0                     ; 0                     ;
;                                             ;                       ;                       ;
; Registered Ports                            ;                       ;                       ;
;     -- Registered Input Ports               ; 0                     ; 3                     ;
;     -- Registered Output Ports              ; 0                     ; 23                    ;
;                                             ;                       ;                       ;
; Port Connectivity                           ;                       ;                       ;
;     -- Input Ports driven by GND            ; 0                     ; 1                     ;
;     -- Output Ports driven by GND           ; 0                     ; 0                     ;
;     -- Input Ports driven by VCC            ; 0                     ; 0                     ;
;     -- Output Ports driven by VCC           ; 0                     ; 0                     ;
;     -- Input Ports with no Source           ; 0                     ; 0                     ;
;     -- Output Ports with no Source          ; 0                     ; 0                     ;
;     -- Input Ports with no Fanout           ; 0                     ; 1                     ;
;     -- Output Ports with no Fanout          ; 0                     ; 18                    ;
+---------------------------------------------+-----------------------+-----------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                                                                                                                                       ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name       ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Address[0] ; W12   ; 8        ; 18           ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Address[1] ; AA11  ; 8        ; 14           ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Address[2] ; Y11   ; 8        ; 16           ; 0            ; 2           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Address[3] ; AD11  ; 8        ; 27           ; 0            ; 3           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Address[4] ; AC11  ; 8        ; 22           ; 0            ; 0           ; 1                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; CLK        ; N1    ; 2        ; 0            ; 18           ; 1           ; 2                     ; 0                  ; yes    ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[0]    ; Y13   ; 7        ; 37           ; 0            ; 3           ; 9                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[1]    ; AB12  ; 8        ; 24           ; 0            ; 1           ; 9                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[2]    ; AA12  ; 8        ; 29           ; 0            ; 1           ; 9                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[3]    ; AD12  ; 8        ; 31           ; 0            ; 3           ; 9                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[4]    ; AC12  ; 8        ; 24           ; 0            ; 0           ; 8                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[5]    ; U12   ; 8        ; 29           ; 0            ; 2           ; 8                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[6]    ; AE11  ; 8        ; 27           ; 0            ; 2           ; 8                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Data[7]    ; Y12   ; 8        ; 29           ; 0            ; 0           ; 8                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; SW_A       ; Y10   ; 8        ; 7            ; 0            ; 0           ; 32                    ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;
; Wren       ; W11   ; 8        ; 18           ; 0            ; 1           ; 7                     ; 0                  ; no     ; no             ; no            ; no              ; no       ; Off          ; 3.3-V LVTTL  ; Off         ; User                 ;

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