vio_xst_verilog_example.arg

来自「Clock data recovery .........good exampl」· ARG 代码 · 共 10 行

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# Usage: generate.exe vio_example -f=<arg_file_name>
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-tool=xst
-language=Verilog
-outputdirectory=C:\ISE_designs\CDRE1T1\Verilog_version\code\cspro
-compname=vio
-asyncinwidth=2
-asyncoutwidth=64