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Timing Analyzer report for usbbus
Wed Feb 15 15:39:00 2006
Version 4.0 Build 190 1/28/2004 SJ Full Version
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Timing Analyzer Settings
3. Timing Analyzer Summary
4. tpd
5. Minimum tpd
6. Timing Analyzer Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2004 Altera Corporation
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support information, device programming or simulation file, and any other
associated documentation or information provided by Altera or a partner
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partner, remains with Altera, the megafunction partner, or their respective
licensors. No other licenses, including any licenses needed under any third
party's intellectual property, are provided herein.
+----------------------------------------------------------------------------------------+
; Timing Analyzer Settings ;
+-----------------------------------------------------------------------------------------
; Option ; Setting ; From ; To ;
+-------------------------------------------------------+--------------------+------+----+
; Device name ; EPM3256ATC144-10 ; ; ;
; Report IO Paths Separately ; Off ; ; ;
; Ignore user-defined clock settings ; Off ; ; ;
; Default hold multicycle ; Same as Multicycle ; ; ;
; Cut off feedback from I/O pins ; On ; ; ;
; Cut off clear and preset signal paths ; On ; ; ;
; Cut off read during write signal paths ; On ; ; ;
; Cut paths between unrelated clock domains ; On ; ; ;
; Run Minimum Analysis ; On ; ; ;
; Use Minimum Timing Models ; Off ; ; ;
; Number of paths to report ; 200 ; ; ;
; Number of destination nodes to report ; 10 ; ; ;
; Number of source nodes to report per destination node ; 10 ; ; ;
+-------------------------------------------------------+--------------------+------+----+
+-----------------------------------------------------------------------------+
; Timing Analyzer Summary ;
+------------------------------------------------------------------------------
; Type ; Slack ; Required Time ; Actual Time ; From ; To ;
+------------------------+-------+---------------+-------------+------+-------+
; Worst-case tpd ; N/A ; None ; 16.600 ns ; RD ; pa[7] ;
; Worst-case minimum tpd ; N/A ; None ; 9.400 ns ; WR ; D[7] ;
+------------------------+-------+---------------+-------------+------+-------+
+--------------------------------------------------------------+
; tpd ;
+---------------------------------------------------------------
; Slack ; Required P2P Time ; Actual P2P Time ; From ; To ;
+-------+-------------------+-----------------+--------+-------+
; N/A ; None ; 16.600 ns ; RD ; pa[0] ;
; N/A ; None ; 16.600 ns ; RD ; pa[1] ;
; N/A ; None ; 16.600 ns ; RD ; pa[2] ;
; N/A ; None ; 16.600 ns ; RD ; pa[3] ;
; N/A ; None ; 16.600 ns ; RD ; pa[4] ;
; N/A ; None ; 16.600 ns ; RD ; pa[5] ;
; N/A ; None ; 16.600 ns ; RD ; pa[6] ;
; N/A ; None ; 16.600 ns ; RD ; pa[7] ;
; N/A ; None ; 10.000 ns ; D[0] ; pa[0] ;
; N/A ; None ; 10.000 ns ; pa[0] ; D[0] ;
; N/A ; None ; 10.000 ns ; D[1] ; pa[1] ;
; N/A ; None ; 10.000 ns ; pa[1] ; D[1] ;
; N/A ; None ; 10.000 ns ; D[2] ; pa[2] ;
; N/A ; None ; 10.000 ns ; pa[2] ; D[2] ;
; N/A ; None ; 10.000 ns ; D[3] ; pa[3] ;
; N/A ; None ; 10.000 ns ; pa[3] ; D[3] ;
; N/A ; None ; 10.000 ns ; D[4] ; pa[4] ;
; N/A ; None ; 10.000 ns ; pa[4] ; D[4] ;
; N/A ; None ; 10.000 ns ; D[5] ; pa[5] ;
; N/A ; None ; 10.000 ns ; pa[5] ; D[5] ;
; N/A ; None ; 10.000 ns ; D[6] ; pa[6] ;
; N/A ; None ; 10.000 ns ; pa[6] ; D[6] ;
; N/A ; None ; 10.000 ns ; D[7] ; pa[7] ;
; N/A ; None ; 10.000 ns ; pa[7] ; D[7] ;
; N/A ; None ; 10.000 ns ; PBN[0] ; PB[0] ;
; N/A ; None ; 10.000 ns ; PBN[1] ; PB[1] ;
; N/A ; None ; 10.000 ns ; PBN[2] ; PB[2] ;
; N/A ; None ; 10.000 ns ; PBN[3] ; PB[3] ;
; N/A ; None ; 10.000 ns ; PBN[4] ; PB[4] ;
; N/A ; None ; 10.000 ns ; PBN[5] ; PB[5] ;
; N/A ; None ; 10.000 ns ; PBN[6] ; PB[6] ;
; N/A ; None ; 10.000 ns ; PBN[7] ; PB[7] ;
; N/A ; None ; 10.000 ns ; PC3 ; LED3 ;
; N/A ; None ; 10.000 ns ; PC2 ; LED2 ;
; N/A ; None ; 10.000 ns ; PC1 ; LED1 ;
; N/A ; None ; 10.000 ns ; PC0 ; LED0 ;
; N/A ; None ; 10.000 ns ; K3 ; PC7 ;
; N/A ; None ; 10.000 ns ; K2 ; PC6 ;
; N/A ; None ; 10.000 ns ; K1 ; PC5 ;
; N/A ; None ; 10.000 ns ; K0 ; PC4 ;
; N/A ; None ; 10.000 ns ; PD5 ; A0 ;
; N/A ; None ; 10.000 ns ; RD ; RDN ;
; N/A ; None ; 10.000 ns ; WR ; WRN ;
; N/A ; None ; 10.000 ns ; INT ; PD2 ;
; N/A ; None ; 9.400 ns ; WR ; D[0] ;
; N/A ; None ; 9.400 ns ; WR ; D[1] ;
; N/A ; None ; 9.400 ns ; WR ; D[2] ;
; N/A ; None ; 9.400 ns ; WR ; D[3] ;
; N/A ; None ; 9.400 ns ; WR ; D[4] ;
; N/A ; None ; 9.400 ns ; WR ; D[5] ;
; N/A ; None ; 9.400 ns ; WR ; D[6] ;
; N/A ; None ; 9.400 ns ; WR ; D[7] ;
+-------+-------------------+-----------------+--------+-------+
+----------------------------------------------------------------------+
; Minimum tpd ;
+-----------------------------------------------------------------------
; Minimum Slack ; Required P2P Time ; Actual P2P Time ; From ; To ;
+---------------+-------------------+-----------------+--------+-------+
; N/A ; None ; 9.400 ns ; WR ; D[7] ;
; N/A ; None ; 9.400 ns ; WR ; D[6] ;
; N/A ; None ; 9.400 ns ; WR ; D[5] ;
; N/A ; None ; 9.400 ns ; WR ; D[4] ;
; N/A ; None ; 9.400 ns ; WR ; D[3] ;
; N/A ; None ; 9.400 ns ; WR ; D[2] ;
; N/A ; None ; 9.400 ns ; WR ; D[1] ;
; N/A ; None ; 9.400 ns ; WR ; D[0] ;
; N/A ; None ; 10.000 ns ; INT ; PD2 ;
; N/A ; None ; 10.000 ns ; WR ; WRN ;
; N/A ; None ; 10.000 ns ; RD ; RDN ;
; N/A ; None ; 10.000 ns ; PD5 ; A0 ;
; N/A ; None ; 10.000 ns ; K0 ; PC4 ;
; N/A ; None ; 10.000 ns ; K1 ; PC5 ;
; N/A ; None ; 10.000 ns ; K2 ; PC6 ;
; N/A ; None ; 10.000 ns ; K3 ; PC7 ;
; N/A ; None ; 10.000 ns ; PC0 ; LED0 ;
; N/A ; None ; 10.000 ns ; PC1 ; LED1 ;
; N/A ; None ; 10.000 ns ; PC2 ; LED2 ;
; N/A ; None ; 10.000 ns ; PC3 ; LED3 ;
; N/A ; None ; 10.000 ns ; PBN[7] ; PB[7] ;
; N/A ; None ; 10.000 ns ; PBN[6] ; PB[6] ;
; N/A ; None ; 10.000 ns ; PBN[5] ; PB[5] ;
; N/A ; None ; 10.000 ns ; PBN[4] ; PB[4] ;
; N/A ; None ; 10.000 ns ; PBN[3] ; PB[3] ;
; N/A ; None ; 10.000 ns ; PBN[2] ; PB[2] ;
; N/A ; None ; 10.000 ns ; PBN[1] ; PB[1] ;
; N/A ; None ; 10.000 ns ; PBN[0] ; PB[0] ;
; N/A ; None ; 10.000 ns ; pa[7] ; D[7] ;
; N/A ; None ; 10.000 ns ; D[7] ; pa[7] ;
; N/A ; None ; 10.000 ns ; pa[6] ; D[6] ;
; N/A ; None ; 10.000 ns ; D[6] ; pa[6] ;
; N/A ; None ; 10.000 ns ; pa[5] ; D[5] ;
; N/A ; None ; 10.000 ns ; D[5] ; pa[5] ;
; N/A ; None ; 10.000 ns ; pa[4] ; D[4] ;
; N/A ; None ; 10.000 ns ; D[4] ; pa[4] ;
; N/A ; None ; 10.000 ns ; pa[3] ; D[3] ;
; N/A ; None ; 10.000 ns ; D[3] ; pa[3] ;
; N/A ; None ; 10.000 ns ; pa[2] ; D[2] ;
; N/A ; None ; 10.000 ns ; D[2] ; pa[2] ;
; N/A ; None ; 10.000 ns ; pa[1] ; D[1] ;
; N/A ; None ; 10.000 ns ; D[1] ; pa[1] ;
; N/A ; None ; 10.000 ns ; pa[0] ; D[0] ;
; N/A ; None ; 10.000 ns ; D[0] ; pa[0] ;
; N/A ; None ; 16.600 ns ; RD ; pa[7] ;
; N/A ; None ; 16.600 ns ; RD ; pa[6] ;
; N/A ; None ; 16.600 ns ; RD ; pa[5] ;
; N/A ; None ; 16.600 ns ; RD ; pa[4] ;
; N/A ; None ; 16.600 ns ; RD ; pa[3] ;
; N/A ; None ; 16.600 ns ; RD ; pa[2] ;
; N/A ; None ; 16.600 ns ; RD ; pa[1] ;
; N/A ; None ; 16.600 ns ; RD ; pa[0] ;
+---------------+-------------------+-----------------+--------+-------+
+---------------------------+
; Timing Analyzer Messages ;
+---------------------------+
Info: *******************************************************************
Info: Running Quartus II Timing Analyzer
Info: Version 4.0 Build 190 1/28/2004 SJ Full Version
Info: Processing started: Wed Feb 15 15:39:00 2006
Info: Command: quartus_tan --import_settings_files=off --export_settings_files=off usbbus -c usbbus
Info: Started post-fitting delay annotation
Info: Delay annotation completed successfully
Info: Longest tpd from source pin RD to destination pin pa[0] is 16.600 ns
Info: 1: + IC(0.000 ns) + CELL(1.200 ns) = 1.200 ns; Loc. = Pin_61; Fanout = 2; PIN Node = 'RD'
Info: 2: + IC(3.200 ns) + CELL(4.000 ns) = 8.400 ns; Loc. = LC161; Fanout = 8; COMB Node = 'RD~3'
Info: 3: + IC(3.200 ns) + CELL(5.000 ns) = 16.600 ns; Loc. = Pin_32; Fanout = 0; PIN Node = 'pa[0]'
Info: Total cell delay = 10.200 ns ( 61.45 % )
Info: Total interconnect delay = 6.400 ns ( 38.55 % )
Info: Shortest tpd from source pin WR to destination pin D[7] is 9.400 ns
Info: 1: + IC(0.000 ns) + CELL(1.200 ns) = 1.200 ns; Loc. = Pin_60; Fanout = 9; PIN Node = 'WR'
Info: 2: + IC(3.200 ns) + CELL(5.000 ns) = 9.400 ns; Loc. = Pin_70; Fanout = 0; PIN Node = 'D[7]'
Info: Total cell delay = 6.200 ns ( 65.96 % )
Info: Total interconnect delay = 3.200 ns ( 34.04 % )
Info: Quartus II Timing Analyzer was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Feb 15 15:39:00 2006
Info: Elapsed time: 00:00:00
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