dds.fit.rpt
来自「多功能函数发生器」· RPT 代码 · 共 527 行 · 第 1/5 页
RPT
527 行
; |sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr| ; 23 (23) ; 9 ; 0 ; 0 ; 0 ; 14 (14) ; 0 (0) ; 9 (9) ; 5 (5) ; |dds|data_sin:u34|altsyncram:altsyncram_component|altsyncram_rot:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr ;
; |data_v:u31| ; 59 (0) ; 35 ; 2048 ; 0 ; 0 ; 24 (0) ; 0 (0) ; 35 (0) ; 17 (0) ; |dds|data_v:u31 ;
; |altsyncram:altsyncram_component| ; 59 (0) ; 35 ; 2048 ; 0 ; 0 ; 24 (0) ; 0 (0) ; 35 (0) ; 17 (0) ; |dds|data_v:u31|altsyncram:altsyncram_component ;
; |altsyncram_8it:auto_generated| ; 59 (0) ; 35 ; 2048 ; 0 ; 0 ; 24 (0) ; 0 (0) ; 35 (0) ; 17 (0) ; |dds|data_v:u31|altsyncram:altsyncram_component|altsyncram_8it:auto_generated ;
; |altsyncram_iab2:altsyncram1| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|data_v:u31|altsyncram:altsyncram_component|altsyncram_8it:auto_generated|altsyncram_iab2:altsyncram1 ;
; |sld_mod_ram_rom:mgl_prim2| ; 59 (37) ; 35 ; 0 ; 0 ; 0 ; 24 (11) ; 0 (0) ; 35 (26) ; 17 (12) ; |dds|data_v:u31|altsyncram:altsyncram_component|altsyncram_8it:auto_generated|sld_mod_ram_rom:mgl_prim2 ;
; |sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr| ; 22 (22) ; 9 ; 0 ; 0 ; 0 ; 13 (13) ; 0 (0) ; 9 (9) ; 5 (5) ; |dds|data_v:u31|altsyncram:altsyncram_component|altsyncram_8it:auto_generated|sld_mod_ram_rom:mgl_prim2|sld_rom_sr:\ram_rom_logic_gen:name_gen:info_rom_sr ;
; |sld_hub:sld_hub_inst| ; 166 (47) ; 106 ; 0 ; 0 ; 0 ; 60 (41) ; 34 (0) ; 72 (6) ; 6 (0) ; |dds|sld_hub:sld_hub_inst ;
; |lpm_decode:instruction_decoder| ; 5 (0) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_decode:instruction_decoder ;
; |decode_9ie:auto_generated| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (5) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_decode:instruction_decoder|decode_9ie:auto_generated ;
; |lpm_shiftreg:jtag_ir_register| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 (0) ; 8 (8) ; 2 (2) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_shiftreg:jtag_ir_register ;
; |sld_dffex:BROADCAST| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:BROADCAST ;
; |sld_dffex:IRF_ENA_0| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:IRF_ENA_0 ;
; |sld_dffex:IRF_ENA| ; 4 (4) ; 4 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 4 (4) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:IRF_ENA ;
; |sld_dffex:IRSR| ; 10 (10) ; 9 ; 0 ; 0 ; 0 ; 1 (1) ; 5 (5) ; 4 (4) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:IRSR ;
; |sld_dffex:RESET| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:RESET ;
; |sld_dffex:\GEN_IRF:1:IRF| ; 6 (6) ; 5 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (5) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:1:IRF ;
; |sld_dffex:\GEN_IRF:2:IRF| ; 6 (6) ; 5 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (5) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:2:IRF ;
; |sld_dffex:\GEN_IRF:3:IRF| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (5) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:3:IRF ;
; |sld_dffex:\GEN_IRF:4:IRF| ; 6 (6) ; 5 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (5) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:4:IRF ;
; |sld_dffex:\GEN_SHADOW_IRF:1:S_IRF| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:1:S_IRF ;
; |sld_dffex:\GEN_SHADOW_IRF:2:S_IRF| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:2:S_IRF ;
; |sld_dffex:\GEN_SHADOW_IRF:3:S_IRF| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:3:S_IRF ;
; |sld_dffex:\GEN_SHADOW_IRF:4:S_IRF| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:4:S_IRF ;
; |sld_jtag_state_machine:jtag_state_machine| ; 21 (21) ; 19 ; 0 ; 0 ; 0 ; 2 (2) ; 0 (0) ; 19 (19) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_jtag_state_machine:jtag_state_machine ;
; |sld_rom_sr:HUB_INFO_REG| ; 23 (23) ; 10 ; 0 ; 0 ; 0 ; 13 (13) ; 0 (0) ; 10 (10) ; 6 (6) ; |dds|sld_hub:sld_hub_inst|sld_rom_sr:HUB_INFO_REG ;
+---------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+----------------------------------------------------------------------------------------------------------------------------------------------------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-----------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+-----------+----------+---------------+---------------+-----------------------+-----+
; switch[0] ; Input ; ON ; ON ; -- ; -- ;
; switch[1] ; Input ; ON ; ON ; -- ; -- ;
; clk ; Input ; OFF ; OFF ; -- ; -- ;
; f_c[5] ; Input ; ON ; ON ; -- ; -- ;
; f_c[4] ; Input ; ON ; ON ; -- ; -- ;
; f_c[3] ; Input ; ON ; ON ; -- ; -- ;
; f_c[2] ; Input ; ON ; ON ; -- ; -- ;
; f_c[1] ; Input ; ON ; ON ; -- ; -- ;
; f_c[0] ; Input ; ON ; ON ; -- ; -- ;
; s_out[0] ; Output ; -- ; -- ; -- ; -- ;
; s_out[1] ; Output ; -- ; -- ; -- ; -- ;
; s_out[2] ; Output ; -- ; -- ; -- ; -- ;
; s_out[3] ; Output ; -- ; -- ; -- ; -- ;
; s_out[4] ; Output ; -- ; -- ; -- ; -- ;
; s_out[5] ; Output ; -- ; -- ; -- ; -- ;
; s_out[6] ; Output ; -- ; -- ; -- ; -- ;
; s_out[7] ; Output ; -- ; -- ; -- ; -- ;
+-----------+----------+---------------+---------------+-----------------------+-----+
+----------------------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+----------------------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+----------------------------------+-------------------+---------+
; switch[0] ; ; ;
; - d_switch:u2|sw_out[0]~108 ; 1 ; ON ;
; - d_switch:u2|sw_out[0]~109 ; 1 ; ON ;
; - d_switch:u2|sw_out[1]~110 ; 1 ; ON ;
; - d_switch:u2|sw_out[2]~112 ; 1 ; ON ;
; - d_switch:u2|sw_out[2]~113 ; 1 ; ON ;
; - d_switch:u2|sw_out[3]~114 ; 1 ; ON ;
; - d_switch:u2|sw_out[4]~116 ; 1 ; ON ;
; - d_switch:u2|sw_out[4]~117 ; 1 ; ON ;
; - d_switch:u2|sw_out[5]~118 ; 1 ; ON ;
; - d_switch:u2|sw_out[6]~120 ; 1 ; ON ;
; - d_switch:u2|sw_out[6]~121 ; 1 ; ON ;
; - d_switch:u2|sw_out[7]~122 ; 1 ; ON ;
; switch[1] ; ; ;
; - d_switch:u2|sw_out[0]~108 ; 1 ; ON ;
; - d_switch:u2|sw_out[1]~110 ; 1 ; ON ;
; - d_switch:u2|sw_out[1]~111 ; 1 ; ON ;
; - d_switch:u2|sw_out[2]~112 ; 1 ; ON ;
; - d_switch:u2|sw_out[3]~114 ; 1 ; ON ;
; - d_switch:u2|sw_out[3]~115 ; 1 ; ON ;
; - d_switch:u2|sw_out[4]~116 ; 1 ; ON ;
; - d_switch:u2|sw_out[5]~118 ; 1 ; ON ;
; - d_switch:u2|sw_out[5]~119 ; 1 ; ON ;
; - d_switch:u2|sw_out[6]~120 ; 1 ; ON ;
; - d_switch:u2|sw_out[7]~122 ; 1 ; ON ;
; - d_switch:u2|sw_out[7]~123 ; 1 ; ON ;
; clk ; ; ;
; f_c[5] ; ; ;
; - adder:u1|s[7] ; 1 ; ON ;
; f_c[4] ; ; ;
; - adder:u1|s[6] ; 1 ; ON ;
; f_c[3] ; ; ;
; - adder:u1|s[5] ; 1 ; ON ;
; f_c[2] ; ; ;
; - adder:u1|s[4] ; 1 ; ON ;
; f_c[1] ; ; ;
; - adder:u1|s[3] ; 1 ; ON ;
; f_c[0] ; ; ;
; - adder:u1|s[2] ; 1 ; ON ;
+----------------------------------+-------------------+---------+
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