📄 digital_clk.pad
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Release 7.1.01i - par H.39Copyright (c) 1995-2005 Xilinx, Inc. All rights reserved.Fri Mar 25 03:08:01 2005# NOTE: This file is designed to be imported into a spreadsheet program# such as Microsoft Excel for viewing, printing and sorting. The |# character is used as the data field separator. This file is also designed# to support parsing.#INPUT FILE: digital_clk_map.ncdOUTPUT FILE: digital_clk.padPART TYPE: xc2s100eSPEED GRADE: -6PACKAGE: pq208Pinout by Pin Number:-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|Pin Number|Signal Name|Pin Usage|Pin Name|Direction|IO Standard|IO Bank Number|Drive (mA)|Slew Rate|Termination|IOB Delay|Voltage|Constraint|DCI Value|IO Register|Signal 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Default value.** This default Pullup/Pulldown value can be overridden in Bitgen. ****** This value can be any of the allowed voltages (1.5v,1.8v,2.5v,3.3v) or VCCAUX
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