📄 hdllib.ref
字号:
EN digital_clk NULL E:/DEMO_FPGA/digital_clk_timesim.vhd sub00/vhpl00 1111691296
AR dfgf testbench_arch E:/DEMO_FPGA/dfgf.timesim_vhw sub00/vhpl03 1111691299
EN dfgf NULL E:/DEMO_FPGA/dfgf.timesim_vhw sub00/vhpl02 1111691298
AR digital_clk structure E:/DEMO_FPGA/digital_clk_timesim.vhd sub00/vhpl01 1111691297
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