📄 gwdvpb.fit.rpt
字号:
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; GND* ; ;
; 68 ; GND* ; ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; GND* ; ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; GND* ; ;
; 79 ; GND* ; ;
; 80 ; SPUL ; LVTTL/LVCMOS ;
; 81 ; GND* ; ;
; 82 ; GND* ; ;
; 83 ; GND* ; ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; CL ; LVTTL/LVCMOS ;
; 87 ; GND* ; ;
; 88 ; DATA[4] ; LVTTL/LVCMOS ;
; 89 ; DATA[5] ; LVTTL/LVCMOS ;
; 90 ; SEL[0] ; LVTTL/LVCMOS ;
; 91 ; GND* ; ;
; 92 ; DATA[0] ; LVTTL/LVCMOS ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; GND* ; ;
; 96 ; GND* ; ;
; 97 ; GND* ; ;
; 98 ; GND* ; ;
; 99 ; GND* ; ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; GND* ; ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; GND+ ; ;
; 125 ; BCLK ; LVTTL/LVCMOS ;
; 126 ; CLR ; LVTTL/LVCMOS ;
; 127 ; VCC_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_INT ; ;
; 130 ; GND* ; ;
; 131 ; START ; LVTTL/LVCMOS ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; VCC_IO ; ;
; 135 ; GND* ; ;
; 136 ; GND* ; ;
; 137 ; GND* ; ;
; 138 ; GND* ; ;
; 139 ; GND_INT ; ;
; 140 ; GND* ; ;
; 141 ; GND* ; ;
; 142 ; GND* ; ;
; 143 ; GND* ; ;
; 144 ; GND* ; ;
+-------+------------+--------------+
+-----------------------------------------------------------+
; Control Signals ;
+---------+---------+---------+--------------+--------------+
; Name ; Pin # ; Fan-Out ; Usage ; Global Usage ;
+---------+---------+---------+--------------+--------------+
; ENA ; LC4_E24 ; 34 ; Clock enable ; Non-global ;
; BENA~16 ; LC4_F29 ; 32 ; Clock enable ; Non-global ;
; CLK2 ; LC1_E24 ; 2 ; Clock ; Internal ;
; MA~4 ; LC3_E24 ; 1 ; Clock ; Non-global ;
; TCLK ; 55 ; 35 ; Clock ; Pin ;
; CLR ; 126 ; 68 ; Async. clear ; Pin ;
; BCLK ; 125 ; 32 ; Clock ; Pin ;
+---------+---------+---------+--------------+--------------+
+-------------------------------------+
; Global & Other Fast Signals ;
+--------+---------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+--------+---------+---------+--------+
; SEL[2] ; 54 ; 24 ; no ;
; SEL[1] ; 56 ; 24 ; no ;
; CLK2 ; LC1_E24 ; 2 ; yes ;
; TCLK ; 55 ; 35 ; yes ;
; CLR ; 126 ; 68 ; yes ;
; BCLK ; 125 ; 32 ; yes ;
+--------+---------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 - 2 ; 0 ;
; 3 - 5 ; 0 ;
; 6 - 8 ; 0 ;
; 9 - 11 ; 0 ;
; 12 - 14 ; 0 ;
; 15 - 17 ; 0 ;
; 18 - 20 ; 0 ;
; 21 - 23 ; 0 ;
; 24 - 26 ; 0 ;
; 27 - 29 ; 0 ;
; 30 - 32 ; 2 ;
+--------------------+------------------------+
+--------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+----------------------------------------------------------------------------+---------+
; ENA~1 ; 34 ;
; BENA~17 ; 32 ;
; SEL[2] ; 24 ;
; SEL[1] ; 24 ;
; SEL[0] ; 8 ;
; CL ; 3 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[25]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[29]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[21]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[5]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[3]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[4]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[23]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[20]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[3]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[21]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[6]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[19]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[4]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[17]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[15]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[13]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[28]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[19]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[9]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[22]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[20]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[29]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[28]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[27]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[25]~COUT ; 2 ;
; Q3~1 ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[18]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[15]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[18]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[16]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[14]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[14]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[12]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[27]~COUT ; 2 ;
; lpm_counter:TSQ_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[13]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[10]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[11]~COUT ; 2 ;
; lpm_counter:BZQ_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[8]~COUT ; 2 ;
+----------------------------------------------------------------------------+---------+
+----------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+-------------------+---------+-------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+-------------------+---------+-------+-----------------+---------------------------+----------+
; CLK2 ; LC1_E24 ; Clock ; no ; yes ; -ve ;
+-------------------+---------+-------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 201 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 2 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 0 ;
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