📄 songer.fit.rpt
字号:
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; Floorplan View ;
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Floorplan report data cannot be output to ASCII.
Please use Quartus II to view the floorplan report data.
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; Pin-Out File ;
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The pin-out file can be found in F:/eda/EDA-1C6/EDA-1C6/Music1/SONGER.pin.
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; Fitter Resource Usage Summary ;
+--------------------------------+-------------------------------------------------------------------------+
; Resource ; Usage ;
+--------------------------------+-------------------------------------------------------------------------+
; Logic cells ; 120 / 5,980 ( 2 % ) ;
; Registers ; 25 / 6,523 ( < 1 % ) ;
; Total LABs ; 14 / 598 ( 2 % ) ;
; Logic elements in carry chains ; 23 ;
; User inserted logic cells ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 8 / 185 ( 4 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 0 ;
; M4Ks ; 0 / 20 ( 0 % ) ;
; Total memory bits ; 0 / 92,160 ( 0 % ) ;
; Total RAM block bits ; 0 / 92,160 ( 0 % ) ;
; Global clocks ; 0 / 8 ( 0 % ) ;
; Maximum fan-out node ; NoteTabs:u1|lpm_counter:Counter_rtl_0|cntr_ia7:auto_generated|safe_q[0] ;
; Maximum fan-out ; 43 ;
; Total fan-out ; 483 ;
; Average fan-out ; 3.72 ;
+--------------------------------+-------------------------------------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLK12MHZ ; 29 ; 1 ; 0 ; 11 ; 0 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CLK8HZ ; 153 ; 3 ; 35 ; 12 ; 1 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
; CODE1[0] ; 13 ; 1 ; 0 ; 17 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; CODE1[1] ; 14 ; 1 ; 0 ; 16 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; CODE1[2] ; 15 ; 1 ; 0 ; 16 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; CODE1[3] ; 16 ; 1 ; 0 ; 16 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; HIGH1 ; 141 ; 3 ; 35 ; 8 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; SPKOUT ; 174 ; 3 ; 35 ; 18 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+----------+-----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 7 / 44 ( 15 % ) ; 3.3V ; -- ;
; 2 ; 0 / 48 ( 0 % ) ; 3.3V ; -- ;
; 3 ; 3 / 45 ( 6 % ) ; 3.3V ; -- ;
; 4 ; 0 / 48 ( 0 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 8 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 10 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 11 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 12 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 13 ; 10 ; 1 ; CODE1[0] ; output ; LVTTL ; ; Row I/O ; Y ;
; 14 ; 11 ; 1 ; CODE1[1] ; output ; LVTTL ; ; Row I/O ; Y ;
; 15 ; 12 ; 1 ; CODE1[2] ; output ; LVTTL ; ; Row I/O ; Y ;
; 16 ; 13 ; 1 ; CODE1[3] ; output ; LVTTL ; ; Row I/O ; Y ;
; 17 ; 14 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 18 ; 15 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 19 ; 16 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 20 ; 17 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 21 ; 18 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 22 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 23 ; 19 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 24 ; 20 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 25 ; 21 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 26 ; 22 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 27 ; ; 1 ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 28 ; 23 ; 1 ; GND+ ; ; ; ; Row I/O ; ;
; 29 ; 24 ; 1 ; CLK12MHZ ; input ; LVTTL ; ; Row I/O ; Y ;
; 30 ; ; 1 ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 31 ; ; 1 ; GNDG_PLL1 ; gnd ; ; ; -- ; ;
; 32 ; 25 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 33 ; 26 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 34 ; 27 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 35 ; 28 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 36 ; 29 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 37 ; 30 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 38 ; 31 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 39 ; 32 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 40 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 41 ; 33 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 42 ; 34 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 43 ; 35 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 44 ; 36 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 45 ; 37 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 46 ; 38 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 47 ; 39 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 48 ; 40 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 49 ; 41 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 50 ; 42 ; 1 ; GND* ; ; ; ; Row I/O ; ;
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