📄 test.sim.rpt
字号:
; |test|LD~3 ; |test|LD~3 ; combout ;
; |test|LD~3 ; |test|LD[28]~output ; padio ;
; |test|LD~4 ; |test|LD~4 ; combout ;
; |test|LD~4 ; |test|LD[27]~output ; padio ;
; |test|LD~5 ; |test|LD~5 ; combout ;
; |test|LD~5 ; |test|LD[26]~output ; padio ;
; |test|LD~6 ; |test|LD~6 ; combout ;
; |test|LD~6 ; |test|LD[25]~output ; padio ;
; |test|LD~7 ; |test|LD~7 ; combout ;
; |test|LD~7 ; |test|LD[24]~output ; padio ;
; |test|LD~8 ; |test|LD[23]~output ; padio ;
; |test|LD~9 ; |test|LD~9 ; combout ;
; |test|LD~9 ; |test|LD[22]~output ; padio ;
; |test|LD~10 ; |test|LD[21]~output ; padio ;
; |test|LD~11 ; |test|LD~11 ; combout ;
; |test|LD~11 ; |test|LD[20]~output ; padio ;
; |test|LD~12 ; |test|LD[19]~output ; padio ;
; |test|LD~13 ; |test|LD~13 ; combout ;
; |test|LD~13 ; |test|LD[18]~output ; padio ;
; |test|LD~14 ; |test|LD[17]~output ; padio ;
; |test|LD~15 ; |test|LD[16]~output ; padio ;
; |test|LD~16 ; |test|LD[15]~output ; padio ;
; |test|LD~17 ; |test|LD[14]~output ; padio ;
; |test|LD~18 ; |test|LD~18 ; combout ;
; |test|LD~18 ; |test|LD[13]~output ; padio ;
; |test|LD~19 ; |test|LD~19 ; combout ;
; |test|LD~19 ; |test|LD[12]~output ; padio ;
; |test|LD~20 ; |test|LD[11]~output ; padio ;
; |test|LD~21 ; |test|LD[10]~output ; padio ;
; |test|LD~22 ; |test|LD~22 ; combout ;
; |test|LD~22 ; |test|LD[9]~output ; padio ;
; |test|LD~23 ; |test|LD[8]~output ; padio ;
; |test|LD~24 ; |test|LD[7]~output ; padio ;
; |test|LD~25 ; |test|LD[6]~output ; padio ;
; |test|LD~26 ; |test|LD[5]~output ; padio ;
; |test|LD~27 ; |test|LD~27 ; combout ;
; |test|LD~27 ; |test|LD[4]~output ; padio ;
; |test|LD~28 ; |test|LD[3]~output ; padio ;
; |test|LD~29 ; |test|LD[2]~output ; padio ;
; |test|LD~30 ; |test|LD[1]~output ; padio ;
; |test|LD~31 ; |test|LD[0]~output ; padio ;
; |test|LA[31]~output ; |test|LA[31]~output ; padio ;
; |test|LA[30]~output ; |test|LA[30]~output ; padio ;
; |test|LA[29]~output ; |test|LA[29]~output ; padio ;
; |test|LA[28]~output ; |test|LA[28]~output ; padio ;
; |test|LA[27]~output ; |test|LA[27]~output ; padio ;
; |test|LA[26]~output ; |test|LA[26]~output ; padio ;
; |test|LA[25]~output ; |test|LA[25]~output ; padio ;
; |test|LA[24]~output ; |test|LA[24]~output ; padio ;
; |test|LA[23]~output ; |test|LA[23]~output ; padio ;
; |test|LA[22]~output ; |test|LA[22]~output ; padio ;
; |test|LA[21]~output ; |test|LA[21]~output ; padio ;
; |test|LA[20]~output ; |test|LA[20]~output ; padio ;
; |test|LA[19]~output ; |test|LA[19]~output ; padio ;
; |test|LA[18]~output ; |test|LA[18]~output ; padio ;
; |test|LA[17]~output ; |test|LA[17]~output ; padio ;
; |test|LA[16]~output ; |test|LA[16]~output ; padio ;
; |test|LA[15]~output ; |test|LA[15]~output ; padio ;
; |test|LA[14]~output ; |test|LA[14]~output ; padio ;
; |test|LA[13]~output ; |test|LA[13]~output ; padio ;
; |test|LA[12]~output ; |test|LA[12]~output ; padio ;
; |test|LA[11]~output ; |test|LA[11]~output ; padio ;
; |test|LA[10]~output ; |test|LA[10]~output ; padio ;
; |test|LA[9]~output ; |test|LA[9]~output ; padio ;
; |test|LA[8]~output ; |test|LA[8]~output ; padio ;
; |test|LA[7]~output ; |test|LA[7]~output ; padio ;
; |test|LA[6]~output ; |test|LA[6]~output ; padio ;
; |test|LA[5]~output ; |test|LA[5]~output ; padio ;
; |test|LA[4]~output ; |test|LA[4]~output ; padio ;
; |test|LA[3]~output ; |test|LA[3]~output ; padio ;
; |test|LA[2]~output ; |test|LA[2]~output ; padio ;
+-------------------------------------------------+-------------------------------------------------+------------------+
The following table displays output ports that do not toggle to 0 during simulation.
+----------------------------------------------------------------------------------------------------------------------+
; Missing 0-Value Coverage ;
+-------------------------------------------------+-------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+-------------------------------------------------+-------------------------------------------------+------------------+
; |test|pllll:inst3|altpll:altpll_component|_clk0 ; |test|pllll:inst3|altpll:altpll_component|_clk0 ; clk0 ;
; |test|int:inst10|wr~reg0 ; |test|int:inst10|wr~reg0 ; regout ;
; |test|int:inst10|blast~reg0 ; |test|int:inst10|blast~reg0 ; regout ;
; |test|int:inst10|process0~4 ; |test|int:inst10|process0~4 ; regout ;
; |test|int:inst10|ccs~reg0 ; |test|int:inst10|ccs~reg0 ; regout ;
; |test|int:inst10|process0~0 ; |test|int:inst10|process0~0 ; regout ;
; |test|int:inst10|tempd1[30] ; |test|int:inst10|tempd1[30] ; regout ;
; |test|int:inst10|tempd1[29] ; |test|int:inst10|tempd1[29] ; regout ;
; |test|int:inst10|tempd1[28] ; |test|int:inst10|tempd1[28] ; regout ;
; |test|rtl~564 ; |test|rtl~564 ; combout ;
; |test|rtl~564 ; |test|int:inst10|tempd1[31] ; regout ;
; |test|int:inst10|tempd1[26] ; |test|int:inst10|tempd1[26] ; regout ;
; |test|int:inst10|tempd1[25] ; |test|int:inst10|tempd1[25] ; regout ;
; |test|int:inst10|tempd1[24] ; |test|int:inst10|tempd1[24] ; regout ;
; |test|rtl~565 ; |test|rtl~565 ; combout ;
; |test|rtl~565 ; |test|int:inst10|tempd1[27] ; regout ;
; |test|int:inst10|tempd1[22] ; |test|int:inst10|tempd1[22] ; regout ;
; |test|int:inst10|tempd1[21] ; |test|int:inst10|tempd1[21] ; regout ;
; |test|int:inst10|tempd1[20] ; |test|int:inst10|tempd1[20] ; regout ;
; |test|rtl~566 ; |test|rtl~566 ; combout ;
; |test|rtl~566 ; |test|int:inst10|tempd1[23] ; regout ;
; |test|int:inst10|tempd1[18] ; |test|int:inst10|tempd1[18] ; regout ;
; |test|int:inst10|tempd1[17] ; |test|int:inst10|tempd1[17] ; regout ;
; |test|int:inst10|tempd1[16] ; |test|int:inst10|tempd1[16] ; regout ;
; |test|rtl~567 ; |test|rtl~567 ; combout ;
; |test|rtl~567 ; |test|int:inst10|tempd1[19] ; regout ;
; |test|rtl~568 ; |test|rtl~568 ; combout ;
; |test|int:inst10|tempd1[14] ; |test|int:inst10|tempd1[14] ; regout ;
; |test|rtl~569 ; |test|rtl~569 ; combout ;
; |test|rtl~569 ; |test|int:inst10|tempd1[15] ; regout ;
; |test|int:inst10|tempd1[10] ; |test|int:inst10|tempd1[10] ; regout ;
; |test|int:inst10|tempd1[9] ; |test|int:inst10|tempd1[9] ; regout ;
; |test|int:inst10|tempd1[8] ; |test|int:inst10|tempd1[8] ; regout ;
; |test|rtl~570 ; |test|rtl~570 ; combout ;
; |test|rtl~570 ; |test|int:inst10|tempd1[11] ; regout ;
; |test|int:inst10|tempd1[12] ; |test|int:inst10|tempd1[12] ; regout ;
; |test|rtl~571 ; |test|rtl~571 ; combout ;
; |test|rtl~571 ; |test|int:inst10|tempd1[13] ; regout ;
; |test|int:inst10|tempd1[6] ; |test|int:inst10|tempd1[6] ; regout ;
; |test|int:inst10|tempd1[5] ; |test|int:inst10|tempd1[5] ; regout ;
; |test|int:inst10|tempd1[4] ; |test|int:inst10|tempd1[4] ; regout ;
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