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altera公司的FPGA的一些开发用的VHDL的源代码用于学习

; |test|pllll:inst3|altpll:altpll_component|_clk0 ; |test|pllll:inst3|altpll:altpll_component|_clk0 ; clk0             ;
; |test|int:inst10|wr~reg0                        ; |test|int:inst10|wr~reg0                        ; regout           ;
; |test|int:inst10|blast~reg0                     ; |test|int:inst10|blast~reg0                     ; regout           ;
; |test|int:inst10|process0~4                     ; |test|int:inst10|process0~4                     ; regout           ;
; |test|int:inst10|ccs~reg0                       ; |test|int:inst10|ccs~reg0                       ; regout           ;
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; |test|rtl~564                                   ; |test|rtl~564                                   ; combout          ;
; |test|rtl~564                                   ; |test|int:inst10|tempd1[31]                     ; regout           ;
; |test|int:inst10|tempd1[26]                     ; |test|int:inst10|tempd1[26]                     ; regout           ;
; |test|int:inst10|tempd1[25]                     ; |test|int:inst10|tempd1[25]                     ; regout           ;
; |test|int:inst10|tempd1[24]                     ; |test|int:inst10|tempd1[24]                     ; regout           ;
; |test|rtl~565                                   ; |test|rtl~565                                   ; combout          ;
; |test|rtl~565                                   ; |test|int:inst10|tempd1[27]                     ; regout           ;
; |test|int:inst10|tempd1[22]                     ; |test|int:inst10|tempd1[22]                     ; regout           ;
; |test|int:inst10|tempd1[21]                     ; |test|int:inst10|tempd1[21]                     ; regout           ;
; |test|int:inst10|tempd1[20]                     ; |test|int:inst10|tempd1[20]                     ; regout           ;
; |test|rtl~566                                   ; |test|rtl~566                                   ; combout          ;
; |test|rtl~566                                   ; |test|int:inst10|tempd1[23]                     ; regout           ;
; |test|int:inst10|tempd1[18]                     ; |test|int:inst10|tempd1[18]                     ; regout           ;
; |test|int:inst10|tempd1[17]                     ; |test|int:inst10|tempd1[17]                     ; regout           ;
; |test|int:inst10|tempd1[16]                     ; |test|int:inst10|tempd1[16]                     ; regout           ;
; |test|rtl~567                                   ; |test|rtl~567                                   ; combout          ;
; |test|rtl~567                                   ; |test|int:inst10|tempd1[19]                     ; regout           ;
; |test|rtl~568                                   ; |test|rtl~568                                   ; combout          ;
; |test|int:inst10|tempd1[14]                     ; |test|int:inst10|tempd1[14]                     ; regout           ;
; |test|rtl~569                                   ; |test|rtl~569                                   ; combout          ;
; |test|rtl~569                                   ; |test|int:inst10|tempd1[15]                     ; regout           ;
; |test|int:inst10|tempd1[10]                     ; |test|int:inst10|tempd1[10]                     ; regout           ;
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; |test|rtl~570                                   ; |test|rtl~570                                   ; combout          ;
; |test|rtl~570                                   ; |test|int:inst10|tempd1[11]                     ; regout           ;
; |test|int:inst10|tempd1[12]                     ; |test|int:inst10|tempd1[12]                     ; regout           ;
; |test|rtl~571                                   ; |test|rtl~571                                   ; combout          ;
; |test|rtl~571                                   ; |test|int:inst10|tempd1[13]                     ; regout           ;
; |test|int:inst10|tempd1[6]                      ; |test|int:inst10|tempd1[6]                      ; regout           ;
; |test|int:inst10|tempd1[5]                      ; |test|int:inst10|tempd1[5]                      ; regout           ;
; |test|int:inst10|tempd1[4]                      ; |test|int:inst10|tempd1[4]                      ; regout           ;
; |test|rtl~572                                   ; |test|rtl~572                                   ; combout          ;
; |test|rtl~572                                   ; |test|int:inst10|tempd1[7]                      ; regout           ;
; |test|int:inst10|tempd1[2]                      ; |test|int:inst10|tempd1[2]                      ; regout           ;
; |test|int:inst10|tempd1[1]                      ; |test|int:inst10|tempd1[1]                      ; regout           ;
; |test|int:inst10|tempd1[0]                      ; |test|int:inst10|tempd1[0]                      ; regout           ;
; |test|rtl~573                                   ; |test|rtl~573                                   ; combout          ;
; |test|rtl~573                                   ; |test|int:inst10|tempd1[3]                      ; regout           ;
; |test|rtl~0                                     ; |test|rtl~0                                     ; combout          ;
; |test|int:inst10|count[23]                      ; |test|int:inst10|count[23]                      ; regout           ;
; |test|int:inst10|count[22]                      ; |test|int:inst10|count[22]                      ; regout           ;
; |test|int:inst10|count[21]                      ; |test|int:inst10|count[21]                      ; regout           ;
; |test|rtl~574                                   ; |test|rtl~574                                   ; combout          ;
; |test|rtl~574                                   ; |test|int:inst10|count[27]                      ; regout           ;
; |test|int:inst10|count[20]                      ; |test|int:inst10|count[20]                      ; regout           ;
; |test|int:inst10|count[15]                      ; |test|int:inst10|count[15]                      ; regout           ;
; |test|int:inst10|count[14]                      ; |test|int:inst10|count[14]                      ; regout           ;
; |test|int:inst10|count[13]                      ; |test|int:inst10|count[13]                      ; regout           ;
; |test|rtl~575                                   ; |test|rtl~575                                   ; combout          ;
; |test|int:inst10|count[10]                      ; |test|int:inst10|count[10]                      ; regout           ;
; |test|int:inst10|count[9]                       ; |test|int:inst10|count[9]                       ; regout           ;
; |test|int:inst10|count[6]                       ; |test|int:inst10|count[6]                       ; regout           ;
; |test|rtl~576                                   ; |test|rtl~576                                   ; combout          ;
; |test|rtl~576                                   ; |test|int:inst10|count[11]                      ; regout           ;
; |test|int:inst10|count[4]                       ; |test|int:inst10|count[4]                       ; regout           ;
; |test|int:inst10|count[3]                       ; |test|int:inst10|count[3]                       ; regout           ;
; |test|int:inst10|count[2]                       ; |test|int:inst10|count[2]                       ; regout           ;
; |test|rtl~577                                   ; |test|rtl~577                                   ; combout          ;
; |test|rtl~577                                   ; |test|int:inst10|count[5]                       ; regout           ;
; |test|rtl~578                                   ; |test|rtl~578                                   ; combout          ;
; |test|int:inst10|count[0]                       ; |test|int:inst10|count[0]                       ; regout           ;
; |test|rtl~579                                   ; |test|rtl~579                                   ; combout          ;
; |test|rtl~579                                   ; |test|int:inst10|count[1]                       ; regout           ;
; |test|int:inst10|count[26]                      ; |test|int:inst10|count[26]                      ; regout           ;
; |test|int:inst10|count[24]                      ; |test|int:inst10|count[24]                      ; regout           ;
; |test|rtl~580                                   ; |test|rtl~580                                   ; combout          ;
; |test|rtl~580                                   ; |test|int:inst10|count[19]                      ; regout           ;
; |test|int:inst10|count[8]                       ; |test|int:inst10|count[8]                       ; regout           ;
; |test|int:inst10|count[18]                      ; |test|int:inst10|count[18]                      ; regout           ;
; |test|int:inst10|count[16]                      ; |test|int:inst10|count[16]                      ; regout           ;
; |test|rtl~581                                   ; |test|rtl~581                                   ; combout          ;
; |test|rtl~581                                   ; |test|int:inst10|count[17]                      ; regout           ;
; |test|rtl~582                                   ; |test|rtl~582                                   ; combout          ;
; |test|rtl~582                                   ; |test|int:inst10|count[7]                       ; regout           ;
; |test|rtl~1                                     ; |test|rtl~1                                     ; combout          ;
; |test|int:inst10|Select~720                     ; |test|int:inst10|Select~720                     ; combout          ;
; |test|rtl~583                                   ; |test|rtl~583                                   ; combout          ;
; |test|rtl~584                                   ; |test|rtl~584                                   ; combout          ;
; |test|rtl~584                                   ; |test|int:inst10|count[25]                      ; regout           ;
; |test|rtl~585                                   ; |test|rtl~585                                   ; combout          ;
; |test|rtl~585                                   ; |test|int:inst10|count[12]                      ; regout           ;
; |test|rtl~586                                   ; |test|rtl~586                                   ; combout          ;
; |test|int:inst10|Select~721                     ; |test|int:inst10|Select~721                     ; combout          ;
; |test|int:inst10|state.done0                    ; |test|int:inst10|state.done0                    ; regout           ;
; |test|int:inst10|Select~722                     ; |test|int:inst10|Select~722                     ; combout          ;
; |test|int:inst10|state.w0                       ; |test|int:inst10|state.w0                       ; regout           ;
; |test|int:inst10|state.r1                       ; |test|int:inst10|state.r1                       ; regout           ;
; |test|int:inst10|process0~318                   ; |test|int:inst10|process0~318                   ; combout          ;
; |test|int:inst10|ccs~7                          ; |test|int:inst10|ccs~7                          ; combout          ;
; |test|int:inst10|ccs~7                          ; |test|int:inst10|process0~7                     ; regout           ;
; |test|int:inst10|ccs~8                          ; |test|int:inst10|ccs~8                          ; combout          ;
; |test|int:inst10|ccs~8                          ; |test|int:inst10|state.r2                       ; regout           ;
; |test|int:inst10|state.r4                       ; |test|int:inst10|state.r4                       ; regout           ;
; |test|int:inst10|state.w3                       ; |test|int:inst10|state.w3                       ; regout           ;
; |test|int:inst10|process0~320                   ; |test|int:inst10|process0~320                   ; combout          ;
; |test|int:inst10|tc[1]                          ; |test|int:inst10|tc[1]                          ; regout           ;
; |test|int:inst10|Select~724                     ; |test|int:inst10|Select~724                     ; combout          ;
; |test|int:inst10|tempd1[31]~0                   ; |test|int:inst10|tempd1[31]~0                   ; combout          ;
; |test|int:inst10|add~449                        ; |test|int:inst10|add~449                        ; combout          ;
; |test|int:inst10|add~449                        ; |test|int:inst10|add~451                        ; cout             ;
; |test|int:inst10|Select~727                     ; |test|int:inst10|Select~727                     ; combout          ;
; |test|int:inst10|add~454                        ; |test|int:inst10|add~454                        ; combout          ;
; |test|int:inst10|add~454                        ; |test|int:inst10|add~456                        ; cout0            ;
; |test|int:inst10|add~454                        ; |test|int:inst10|add~456COUT1_608               ; cout1            ;
; |test|int:inst10|add~459                        ; |test|int:inst10|add~459                        ; combout          ;
; |test|int:inst10|add~459                        ; |test|int:inst10|add~461                        ; cout0            ;
; |test|int:inst10|add~459                        ; |test|int:inst10|add~461COUT1_607               ; cout1            ;
; |test|int:inst10|add~464                        ; |test|int:inst10|add~464                        ; combout          ;
; |test|int:inst10|add~469                        ; |test|int:inst10|add~469                        ; combout          ;
; |test|int:inst10|add~469                        ; |test|int:inst10|add~471                        ; cout0            ;
; |test|int:inst10|add~469                        ; |test|int:inst10|add~471COUT1_606               ; cout1            ;