📄 test.fit.rpt
字号:
; -- asynchronous clear/load mode ; 42 ;
; ; ;
; Total LABs ; 17 / 598 ( 3 % ) ;
; Logic elements in carry chains ; 28 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 73 / 185 ( 39 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 2 ;
; M4Ks ; 0 / 20 ( 0 % ) ;
; Total memory bits ; 0 / 92,160 ( 0 % ) ;
; Total RAM block bits ; 0 / 92,160 ( 0 % ) ;
; PLLs ; 1 / 2 ( 50 % ) ;
; Global clocks ; 2 / 8 ( 25 % ) ;
; Maximum fan-out node ; pllll:inst3|altpll:altpll_component|_clk0 ;
; Maximum fan-out ; 114 ;
; Highest non-global fan-out signal ; int:inst10|s2 ;
; Highest non-global fan-out ; 33 ;
; Total fan-out ; 598 ;
; Average fan-out ; 2.93 ;
+---------------------------------------------+-------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; LINT ; 176 ; 3 ; 35 ; 19 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; LRESETo_ ; 178 ; 3 ; 35 ; 19 ; 0 ; 47 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SYSCLK ; 153 ; 3 ; 35 ; 12 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; ready ; 188 ; 2 ; 30 ; 21 ; 1 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; ADS_ ; 184 ; 2 ; 32 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; BLAST_ ; 182 ; 2 ; 34 ; 21 ; 1 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; CCS_ ; 170 ; 3 ; 35 ; 17 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LCLK ; 187 ; 2 ; 30 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LW/R_ ; 240 ; 2 ; 2 ; 21 ; 2 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; TEST ; 175 ; 3 ; 35 ; 18 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; leed ; 54 ; 1 ; 0 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
+--------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; LA[10] ; 11 ; 1 ; 0 ; 17 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[11] ; 12 ; 1 ; 0 ; 17 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[12] ; 13 ; 1 ; 0 ; 17 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[13] ; 14 ; 1 ; 0 ; 16 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[14] ; 15 ; 1 ; 0 ; 16 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[15] ; 16 ; 1 ; 0 ; 16 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[16] ; 17 ; 1 ; 0 ; 15 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[17] ; 18 ; 1 ; 0 ; 15 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[18] ; 19 ; 1 ; 0 ; 14 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[19] ; 20 ; 1 ; 0 ; 14 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[20] ; 21 ; 1 ; 0 ; 14 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[21] ; 23 ; 1 ; 0 ; 13 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[22] ; 38 ; 1 ; 0 ; 8 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[23] ; 39 ; 1 ; 0 ; 8 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[24] ; 41 ; 1 ; 0 ; 7 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[25] ; 42 ; 1 ; 0 ; 7 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[26] ; 43 ; 1 ; 0 ; 7 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[27] ; 44 ; 1 ; 0 ; 6 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[28] ; 45 ; 1 ; 0 ; 6 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[29] ; 46 ; 1 ; 0 ; 5 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[2] ; 1 ; 1 ; 0 ; 20 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[30] ; 47 ; 1 ; 0 ; 5 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[31] ; 48 ; 1 ; 0 ; 4 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[3] ; 2 ; 1 ; 0 ; 20 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[4] ; 3 ; 1 ; 0 ; 19 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[5] ; 4 ; 1 ; 0 ; 19 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[6] ; 5 ; 1 ; 0 ; 19 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[7] ; 6 ; 1 ; 0 ; 18 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; LA[8] ; 7 ; 1 ; 0 ; 18 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
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